參數(shù)資料
型號： GMS30C7201
英文描述： 32-Bit RISC Microprocessor(32位 RISC 微處理器)
中文描述： 32位RISC微處理器（32位的RISC微處理器）
文件頁數(shù)： 240/354頁
文件大?。?/td> 1639K
代理商： GMS30C7201
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Slow AMBA Peripherals
13-10
GMS30C7201 Data Sheet
13.2.5 Registers description
There are two UARTs implemented in the design, the base addresses are U1Base and
U2Base.
UART Enable register is explained in page 13-20(Test Regsters of Uart)
.
In
Table 13-5: UART register address map
, x can be either 1 or 2.
Table 13-6: Summary of registers
gives details of the UART registers.
Address
Name
Description
UxBase + 0x00
Receiver_Buffer
# 8-bit R/O set DLAB=0
UxBase + 0x00
Transmitter_Holding
# 8-bit W/O set DLAB=0
UxBase + 0x04
Interrupt_Enable
# 8-bit R/W
UxBase + 0x08
Interrupt_Identification
# 8-bit R/O
UxBase + 0x08
FIFO_Control
# 8-bit W/O
UxBase + 0x0C
Line_Control
# 8-bit R/W
UxBase + 0x10
MODEM_Control
# 8-bit R/W
UxBase + 0x14
Line_Status
# 8-bit R/W
UxBase + 0x18
MODEM_Status
# 8-bit R/W
UxBase + 0x1C
Scratch
# 8-bit R/W
UxBase + 0x00
Divisor_Latch_LS
# 8-bit R/W set DLAB=1
UxBase + 0x04
Divisor_Latch_MS
# 8-bit R/W set DLAB=1
Table 13-5: UART register address map
Register Address
0 DLAB=0
0 DLAB=0
1 DLAB=0
1
2
3
4
5
6
7
0 DLAB=1
1 DLAB=1
Bit
No.
Receiver
Buffer
Register
(R/O)
Transmitter
Holding
Register
(W/O)
Interrupt
Enable
Register
Interrupt
Ident
Register
(R/O)
FIFO
Control
Register
(W/O)
Line
Control
Register
Modem
Control
Register
Line Status
Register
Modem
Status
Register
Scratch
Register
Divisor
Latch
(LS)
Divisor
Latch
(MS)
RBR
THR
IER
IIR
FCR
LCR
MCR
LSR
MSR
SCR
DLL
DLM
0
Data Bit 0
(Note 1)
Data Bit 0
Enable
received
data
available
interrupt
0 if
interrupt
pending
FIFO
enable
Word
length
select
Bit 0
Data
Terminal
Ready
(DTR)
Data
Ready
(DR)
Delta
Clear to
Send
(DCTS)
Bit 0
Bit 0
Bit 8
1
Data Bit 1
Data Bit 1
Enable
transmitter
holding
register
empty
interrupt
Interrupt
ID Bit 0
RCVR
FIFO
reset
Word
length
select
Bit 1
Request
to Send
(RTS)
Overrun
Error
(OE)
Delta Data
Set Ready
(DDSR)
Bit 1
Bit 1
Bit 9
Table 13-6: Summary of registers
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PDF描述
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