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參數(shù)資料
| 型號： | GMS30C7201 |
| 英文描述： | 32-Bit RISC Microprocessor(32位 RISC 微處理器) |
| 中文描述： | 32位RISC微處理器（32位的RISC微處理器） |
| 文件頁數(shù)： | 184/354頁 |
| 文件大?。?/td> | 1639K |
| 代理商： | GMS30C7201 |
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Fast AMBA Peripherals
12-28
GMS30C7201 Data Sheet
Sending packets which are not a multiple of 4 bytes in length
The FIFO is 32 bits wide. Loading the FIFO with less than 32 bits would cause
extraneous zero-bits to be transmitted. The IrDataTail register is a mechanism used to
pre-load the last 1, 2 or 3 bytes of a frame. When the DMA transfer is complete and the
transmit FIFO is empty, any bytes stored in the IrDataTail register are transmitted before
the Ir encoder sends the CRC and end of frame flags.There are three distinct
addresses to write the end of frame data to. The addresses are given in
Table 12-29:
Addresses for end of frame data
below. This allows a single word write to specify the
data to be transmitted and the number of trailing bytes to send.
If there is a single byte to transmit, write to address 0x80011014, for two bytes write to
0x80011018 and if there are three trailing bytes write to 0x8001101C.
Starting Transmission
Set IrCon.TXE Transmit enable bit.
12.5.3 End of Frame
End of Buffer Interrupt from DMA
DMAFLAGR.FLAG1 will be set when the number of words specified when initializing
the DMA transfer length. This can be checked in an Interrupt Service Routine and
cleared by writing a 1 to this bit.When this interrupt has occurred, all remaining data to
transmit is either in the FIFO or in the IrDataTail register. At this point, clearing the TUS
bit in the IrCon register will ensure that when transmission is complete the CRC and
end of frame flags are transmitted.
Disable Transmit Circuitry
To save power, after completion of the frame transmission, clear the Transmit Enable
(TXE) bit in the IrEnable register.
12.5.4 Error conditions
Transmit buffer Underrun
This is only signalled if IrCon register bit TUS is set to 1 as described in
Select
Transmit Underrun Action
on page 12-27.
Bytes to transmit
Address to write to
1
0x80011014
2
0x80011018
3
0x8001101C
Table 12-29: Addresses for end of frame data
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