參數(shù)資料
型號： GCIXP1250-200
英文描述： Microprocessor
中文描述： 微處理器
文件頁數(shù)： 28/148頁
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代理商： GCIXP1250-200
Intel
IXP1250 Network Processor
28
Datasheet
3.3
Pin Description, Grouped by Function
3.3.1
Processor Support Pins
Table 12. Processor Support Pins
Processor Support
Signal Names
Pin
Number
Type
Total
Pin Descriptions
PXTAL
E7
I1
1
Input connection for system oscillator. Typically
3.6864 MHz. Drives internal PLL clock generator.
CINT_L
AA30
I1
1
Level-sensitive interrupt input to the StrongARM*
core.
RESET_OUT_L
E8
O4
1
IXP1250 System Reset Output. Asserted when:
RESET_IN_L is asserted.
PCI Central Function and arbiter disabled
(PCI_CFN[1:0]=00) and PCI_RST_L is asserted.
A soft reset is initiated.
The Watchdog Timer expires.
To deassert, write register IXP1250_RESET bit 15.
RESET_IN_L
D8
I1
1
IXP1250 System Reset Input. If asserted, the
IXP1250 will reset and will assert RESET_OUT_L. If
PCI Central Function and arbiter enabled
(PCI_CFN[1:0]=11), PCI_RST_L output will also be
asserted.
Totals:
4
相關(guān)PDF資料
PDF描述
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