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參數(shù)資料
| 型號(hào)： | FW82371 |
| 廠商： | Intel Corp. |
| 英文描述： | PCI-TO-ISA / IDE XCELERATOR PIIX4 |
| 中文描述： | PCI到的ISA / IDE的XCELERATOR PIIX4 |
| 文件頁數(shù)： | 35/284頁 |
| 文件大?。?/td> | 1042K |
| 代理商： | FW82371 |
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E
82371AB (PIIX4)
35
4/9/97 2:23 PM PIIX4aDS
INTEL CONFIDENTIAL
(until publication date)
PRELIMINARY
Name
Type
Description
SUSB#/
GPO15
O
SUSPEND PLANE B CONTROL.
Control signal asserted during power
management suspend states. SUSB# is primarily used to control the secondary
power plane. This signal is asserted during STR and STD suspend states. If the
power plane control is not needed, this pin can be used as a general-purpose output.
During Reset:
Low
After Reset:
High
During POS:
High/GPO
SUSC#/
GPO16
O
SUSPEND PLANE C CONTROL.
Control signal asserted during power
management suspend states, primarily used to control the tertiary power plane.
It is asserted only during STD suspend state. If the power plane control is not
needed, this pin can be used as a general-purpose output.
During Reset:
Low
After Reset:
High
During POS:
High/GPO
SUS_STAT1#/
GPO20
O
SUSPEND STATUS 1.
This signal is typically connected to the Host-to-PCI bridge
and is used to provide information on host clock status. SUS_STAST1# is asserted
when the system may stop the host clock, such as Stop Clock or during POS, STR,
and STD suspend states. If this function is not needed, this pin can be used as a
general-purpose output.
During Reset:
Low
After Reset:
High
During POS:
Low/GPO
SUS_STAT2#/
GPO21
O
SUSPEND STATUS 2.
This signal will typically connect to other system peripherals
and is used to provide information on system suspend state. It is asserted during
POS, STR, and STD suspend states. If this function is not needed, this pin can be
used as a general-purpose output.
During Reset:
Low
After Reset:
High
During POS:
Low/GPO
THRM#/
GPI8
I
THERMAL DETECT.
Active low signal generated by external hardware to start the
Hardware Clock Throttling mode. If enabled, the external hardware can force the
system to enter into Hardware Clock Throttle mode by asserting THRM#. This
causes PIIX4 to cycle STPCLK# at a preset programmable rate. If this function is not
needed, this pin can be used as a general-purpose input.
ZZ/
GPO19
O
LOW-POWER MODE FOR L2 CACHE SRAM.
This signal is used to power down a
cache’s data SRAMs when the clock logic places the CPU into the Stop Clock.
If this function is not needed, this pin can be used as a general-purpose output.
During Reset:
Low
After Reset:
Low
During POS:
Low
2.1.11.
GENERAL PURPOSE INPUT AND OUTPUT SIGNALS
Some of the General Purpose Input and Output signals are multiplexed with other PIIX4 signals. The usage is
determined by the system configuration.
The default pin usage is shown in Table 1 and Table 2. The configuration can be selected via the General
Configuration register and X-Bus Chip Select register.
Name
Type
Description
GPI[21:0]
I
GENERAL PURPOSE INPUTS.
These input signals can be monitored via the GPIREG
register located in Function 3 (Power Management) System IO Space at address
PMBase+30h. See Table 1 for details.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| FW82801E | Intel 82801E Communications I/O Controller Hub (C-ICH) |
| FWB150 | 1.5 AMP FAST RECOVERY BRIDGE RECTIFIERS |
| FWB151 | 1.5 AMP FAST RECOVERY BRIDGE RECTIFIERS |
| FWB1510 | 1.5 AMP FAST RECOVERY BRIDGE RECTIFIERS |
| FWB152 | 1.5 AMP FAST RECOVERY BRIDGE RECTIFIERS |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| FW82371EB | 制造商:Intel 功能描述:IC INTEL 82371EB 352BGA 制造商:Rochester Electronics LLC 功能描述: |
| FW82371EB S L37M | 制造商:Intel 功能描述:Embedded Processor 352-Pin BGA |
| FW82371EB SL37M | 制造商:Intel 功能描述: |
| FW82371MB | 制造商:Rochester Electronics LLC 功能描述:PCI-ISA BRIDGE, T&R, SPEC SL3CG - Bulk |
| FW82439HX | 制造商:Intel 功能描述: |
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