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參數(shù)資料
| 型號(hào)： | FW82371 |
| 廠商： | Intel Corp. |
| 英文描述： | PCI-TO-ISA / IDE XCELERATOR PIIX4 |
| 中文描述： | PCI到的ISA / IDE的XCELERATOR PIIX4 |
| 文件頁(yè)數(shù)： | 255/284頁(yè) |
| 文件大?。?/td> | 1042K |
| 代理商： | FW82371 |
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E
82371AB (PIIX4)
255
4/9/97 2:23 PM PIIX4aDS
INTEL CONFIDENTIAL
(until publication date)
PRELIMINARY
Table 49. On to STD/SOff Timings
Sym
Parameter
Min
Max
Unit
Notes
t103
CPU_STP# and PCI_STP# Inactive to STPCLK# Active
1
RTC
1, 2
t104
STPCLK# Active to SLP# Active
1
RTC
1, 3
t105
SLP# Active to SUS_STAT[1:2]# Active
1
RTC
1
t106
SUS_STAT[1:2]# Active to CPU_STP# and PCI_STP# Active
1
RTC
1
t107
CPU_STP# and PCI_STP# Inactive to Clocks Stopped
2
PCICLK
1, 4, 5
t108
CPU_STP# and PCI_STP# Inactive to SUS[A:C]# Active
1
RTC
1
t109
SUS[A:C]# Active to SUSCLK Low
1
RTC
1
t110
SUS[A:C]# Active to PWROK Inactive
0
ns
6
t111
PWROK Inactive to CPU_STP# and PCI_STP# Float
1
RTC
1
t112
PWROK Inactive to PCI_RST# Active
1
RTC
1
t113
PWROK Inactive to CPURST Active
1
RTC
1
t114
PWROK Inactive to SLP# Inactive
1
RTC
1
t115
PWROK Inactive to STPCLK# Inactive
1
RTC
1
t116
CPU_STP# and PCI_STP# Float to Clocks Invalid
0
ns
1
t117
PWROK Inactive to Core Well Power Removed
0
ns
t118
Core Well Power Removed to PCI_STP# and CPU_STP# Invalid
0
ns
t119
Core Well Power Removed to PCIRST# Invalid
0
ns
t120
Core Well Power Removed to CPURST Invalid
0
ns
t121
Core Well Power Removed to SLP# Invalid
0
ns
t122
Core Well Power Removed to STPCLK# Invalid
0
ns
NOTES:
1.
These signals are controlled off the internal RTC clock. 1 RTC is approximately 32 μs.
2.
CPU_STP# and PCI_STP# will only be active if system is under clock control.
3.
This transition will also wait for the Stop Grant cycle to execute.
4.
It is up to the system vendor to determine if CPU_STP# and PCI_STP# signals are used to control system
clocks.
5.
See Figure 18 and Figure 19 for exact PCICLK requirements for use with PC/PCI DMA and Serial IRQs.
6.
It is up to the system vendor to determine if SUS[A:C]# signals are used to control system power planes. If
power remains applied to system board and PWROK stays active during STD, the PIIX4 signals remain in
the states shown after t110.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| FW82801E | Intel 82801E Communications I/O Controller Hub (C-ICH) |
| FWB150 | 1.5 AMP FAST RECOVERY BRIDGE RECTIFIERS |
| FWB151 | 1.5 AMP FAST RECOVERY BRIDGE RECTIFIERS |
| FWB1510 | 1.5 AMP FAST RECOVERY BRIDGE RECTIFIERS |
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
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| FW82371MB | 制造商:Rochester Electronics LLC 功能描述:PCI-ISA BRIDGE, T&R, SPEC SL3CG - Bulk |
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