參數(shù)資料
型號： AMD-756
廠商： ADVANCED MICRO DEVICES INC
元件分類： 總線控制器
英文描述： Peripheral Bus Controller(外圍總線控制器)
中文描述： UNIVERSAL SERIAL BUS CONTROLLER, PBGA272
封裝： PLASTIC, BGA-272
文件頁數(shù)： 239/368頁
文件大?。?/td> 5363K
代理商： AMD-756
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Chapter 7
Registers
219
22548B/0
—
August 1999
AMD-756
Peripheral Bus Controller Data Sheet
Preliminary Information
Function 1 Registers (EIDE Controller): Drive Timing Control
Offset 4Bh
–
48h
Bit
Name
PD0APW
PD0RT
PD1APW
PD1RT
SD0APW
SD0RT
SD1APW
SD1RT
Default
1010
1000
1010
1000
1010
1000
1010
1000
Description
Access Type
RW
RW
RW
RW
RW
RW
RW
RW
31-28
27-24
2320
19-16
15-12
11-8
7-4
3-0
Note:
Primary Drive 0 Active Pulse Width.
Primary Drive 0 Recovery Time.
Primary Drive 1 Active Pulse Width.
Primary Drive 1 Recovery Time.
Secondary Drive 0 Active Pulse Width.
Secondary Drive 0 Recovery Time.
Secondary Drive 1 Active Pulse Width.
Secondary Drive 1 Recovery Time.
Each field of this register defines the active pulse width and recovery time for a particular IDE DIOR# or DIOW# signal. The actual
value for each field is the encoded value plus one and indicates the number of PCI clocks. The default state (A8h) results in a recovery
time of 270 ns and an active pulse of 330 ns for a 30-ns PCI clock. This corresponds to ATA PIO Mode 0.
Function 1 Registers (EIDE Controller): Address Setup Time
Offset 4Ch
Bit
Name
PD0AST
PD1Ast
SD0AST
SD1AST
Default
11
11
11
11
Description
Access Type
RW
RW
RW
RW
7-6
5-4
3-2
1-0
Note:
Primary Drive 0 Address Setup Time.
Primary Drive 1 Address Setup Time.
Secondary Drive 0 Address Setup Time.
Secondary Drive 1 Address Setup Time.
The coding for the startup timings is as follows:
00 = 1 PCLK 10 = 3 PCLK
01 = 2 PCLK 11 = 4 PCLK
Function 1 Registers (EIDE Controller): Secondary Non-1F0 Port Access Timing
Offset 4Eh
Bit
Name
SAPW
SRT
Default
1111
1111
Description
Access Type
RW
RW
7-4
3-0
Note:
DIOR#/DIOW# Active Pulse Width.
DIOR#/DIOW# Recovery Time.
The actual value in the field is the encoded value plus one and indicates the number of PCI clocks.
Function 1 Registers (EIDE Controller): Primary Non-1F0 Port Access Timing
Offset 4Fh
Bit
Name
PAPW
PRT
Default
1111
1111
Description
Access Type
RW
RW
7-4
3-0
Note:
DIOR#/DIOW# Active Pulse Width.
DIOR#/DIOW# Recovery Time.
The actual value in the field is the encoded value plus one and indicates the number of PCI clocks.
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