參數(shù)資料
型號: AMD-756
廠商: ADVANCED MICRO DEVICES INC
元件分類: 總線控制器
英文描述: Peripheral Bus Controller(外圍總線控制器)
中文描述: UNIVERSAL SERIAL BUS CONTROLLER, PBGA272
封裝: PLASTIC, BGA-272
文件頁數(shù): 224/368頁
文件大小: 5363K
代理商: AMD-756
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204
Registers
Chapter 7
AMD-756
Peripheral Bus Controller Data Sheet
22548B/0
August 1999
Preliminary Information
7.5.1
Function 0 Registers (PCI-ISA Bridge): ISA Bus Control 1
ISA Bus Control
Function 0 Registers (PCI-ISA Bridge): BIST
Offset 0Fh
Bit
Name
Default
00h
Description
Access Type
RO
7-0
BIST.
Always reads 0.
Function 0 Registers (PCI-ISA Bridge): Subsystem ID and Subsystem Vendor ID
Offset 2Fh
2Ch
Bit
Name
Default
0000h
0000h
Description
Access Type
RO
RO
31-16
15-0
Subsystem ID.
Can be configured via offset 50h.
Subsystem Vendor ID.
Can be configured via offset 50h.
Offset 40h
Bit
Name
Default
0
Description
Access Type
7-4
Reserved.
I/O Recovery Time.
0 = There is a minimum of 5.5 BCLK cycles between the trailing edge of an ISA I/O
command signal (IOR# or IOW#) and the leading edge of the next ISA I/O command
signal.
1 = There is a minimum of 13.5 BCLK cycles between adjacent I/O cycles.
This bit does not affect ISA bus memory cycles.
Reserved
.
ROM Wait States.
0 = The ISA command signal (MEMR# or MEMW#) is 2.0 BCLK cycles (wait states) in
duration.
1 = The ISA command signal is 1.0 BCLK cycles (wait state) in duration.
ROM Write.
0 = The ROMCS# is disabled and does not become active during writes to BIOS address
space. MEMW# is active during writes to address space near 1 megabyte but not near 4
gigabytes.
1 = The ROMCS# and MEMW# pins are enabled and become active during writes to the
BIOS address space.
3
IORT
0
RW
2
0
1
RWS
0
RW
0
ROMW
0
RW
Function 0 Registers (PCI-ISA Bridge): ISA Bus Control 2
Offset 41h
Bit
Name
MLEN
Default
0
0
Description
Access Type
7
6
Mouse Lock Enable.
0= This function is disabled. 1 = this function is enabled.
Reserved.
Always reads 0.
Port 92 Fast Reset.
0 = Disables writes to PORT92[0].
1 = Enables writes to PORT92[0].
Reserved.
Always reads 0.
5
P92FR
0
RW
4
0
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