參數(shù)資料
型號(hào)： AMD-756
廠商： ADVANCED MICRO DEVICES INC
元件分類： 總線控制器
英文描述： Peripheral Bus Controller(外圍總線控制器)
中文描述： UNIVERSAL SERIAL BUS CONTROLLER, PBGA272
封裝： PLASTIC, BGA-272
文件頁數(shù)： 124/368頁
文件大?。?/td> 5363K
代理商： AMD-756
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104
Functional Operations
Chapter 5
AMD-756
Peripheral Bus Controller Data Sheet
22548B/0
—
August 1999
Preliminary Information
because it has fully decoded these registers. Table 15 on page
104 shows the relationship between legacy DMA addressing for
Base, Count, and Memory Page registers. It also shows where
this information is programmed into the target DMA. For the
byte legacy DMA, bits 0
–
7 represent address 0
–
7. However, for
the word legacy DMA, bits 0
–
7 represent address 1
–
8. This
carries forward to the next address byte. The memory page
register re-aligns the bit position to the address. This
relationship is maintained in the target DMA. A target DMA
can be programmed to be in 8-bit/16-bit transfer mode from its
PCI configuration space. This mode information defines how
the target DMA treats the data in the registers. Table 15 also
defines optional non-legacy addressing extensions for the
target.
Table 15.
DMA Registers
Legacy Channel
Channel 0
Channel 1
Channel 2
Channel 3
Base Address
0000h
0002h
0004h
0006h
Base Address
0000h
0002h
0004h
0006h
Memory Page
0087h
0083h
0081h
0082h
Count Address Count Address
0001h
0003h
0005h
0007h
0001h
0003h
0005h
0007h
Address 1
–
8
00C0h
00C4h
00C8h
00CCh
Address 9
–
16
00C0h
00C4h
00C8h
00CCh
Address 17
–
23
N/A
008Bh
0089h
008Ah
Address 1
–
8
00C2h
00C6h
00CAh
00CEh
Address 9
–
16
00C2h
00C6h
00CAh
00CEh
Channel 4
Channel 5
Channel 6
Channel 7
Above Channels Map to
Target Address
8-Bit Mode
16-Bit Mode
Base + 0h
Base + 1h
Base + 2h
Base + 4h
Base + 5h
Address 0
–
7
Address 1
–
8
Base Address
Base + 3h
Address 24
–
31
Address 24
–
31
Address 8
–
15
Address 8
–
16
Address 16
–
23
Address 17
–
23
Address 0
–
7
Address 1
–
8
Count Address
Base + 6h
Address 16
–
23
Address 17
–
23
Address 8
–
15
Address 8
–
16
Non-Legacy Target DMA
Addressing Extensions
8-Bit Mode
16-Bit Mode
Notes:
1. Any target DMA that does not support the non-legacy extensions must always return a value of 00h from these locations when
read.
2. It is the responsibility of the master DMA to support the reserved memory page registers. Because the AMD-756 controller imple-
ments subtractive decoding for these registers, master DMA blocks that implement them behave as expected by the distributed
DMA specification.
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