參數(shù)資料
型號： AMD-756
廠商： ADVANCED MICRO DEVICES INC
元件分類： 總線控制器
英文描述： Peripheral Bus Controller(外圍總線控制器)
中文描述： UNIVERSAL SERIAL BUS CONTROLLER, PBGA272
封裝： PLASTIC, BGA-272
文件頁數(shù)： 117/368頁
文件大?。?/td> 5363K
代理商： AMD-756
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Chapter 5
Functional Operations
97
22548B/0
—
August 1999
AMD-756
Peripheral Bus Controller Data Sheet
Preliminary Information
5.10.6
Type F DMA
Type F DMA is supported on all channels. The channels can be
individually enabled to provide Type F DMA timing, using the
Type F DMA control register (Function 0, offset 45h) as shown
in Table 13 on page 97. Therefore, configuration software needs
to detect Type F-capable devices and configure their channels
only once after reset.
D[0]
AD[8]
AD[7]
AD[6]
AD[5]
AD[4]
AD[3]
AD[2]
—
—
—
BE[0]#
BE#[1]
BE#[2]
BE#[3]
AD[9]
AD[8]
AD[7]
AD[6]
AD[5]
AD[4]
AD[3]
AD[2]
A[7]
A[6]
A[5]
A[4]
A[3]
A[2]
A[1]
A[0]
A[0]#
A[1] + A[0]
A[1] + A#[0]
A[1] + A[0]
A#[1] + A#[0]
BE[1], BE[0]
BE[3], BE[2]
—
—
—
—
Table 12.
DMA Addressing for ISA Bus Accesses (DMA/PCI AD Bus) (continued)
Page Register
Outputs
Middle Address
Latch Outputs
8237 Address
Outputs
DMA1 ISA Address
Bits
DMA2 ISA Address
Bits
Table 13.
Type F DMA Control
Offset 45h
Bit 7 = 1
Bit 6 = 1
Bit 5 = 1
Bit 4 = 1
Bit 3 = 1
Bit 2 = 1
Bit 1 = 1
Bit 0 = 1
Type F DMA Control
Default
0
0
0
0
0
0
0
0
ISA Master/DMA to PCI Line Buffer
Enable DMA Type F Timing on Channel 7
Enable DMA Type F Timing on Channel 6
Enable DMA Type F Timing on Channel 5
Enable DMA Type F Timing on Channel 3
Enable DMA Type F Timing on Channel 2
Enable DMA Type F Timing on Channel 1
Enable DMA Type F Timing on Channel 0
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PDF描述
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