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參數(shù)資料
| 型號(hào)： | AMD-756 |
| 廠商： | ADVANCED MICRO DEVICES INC |
| 元件分類： | 總線控制器 |
| 英文描述： | Peripheral Bus Controller(外圍總線控制器) |
| 中文描述： | UNIVERSAL SERIAL BUS CONTROLLER, PBGA272 |
| 封裝： | PLASTIC, BGA-272 |
| 文件頁數(shù)： | 115/368頁 |
| 文件大?。?/td> | 5363K |
| 代理商： | AMD-756 |
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Chapter 5
Functional Operations
95
22548B/0
—
August 1999
AMD-756
Peripheral Bus Controller Data Sheet
Preliminary Information
latched address are then driven on PCI address bits AD[15:8]
for 8-bit channels and AD[16:9] for 16-bit channels.
The lower address portion is generated directly by the 8237
megacells during DMA operations, and the lower address bits
are output on PCI address bits AD[7:0] for 8-bit channels and
AD[8:1] for 16-bit channels.
SBHE# is configured as an output during all DMA operations It
is driven as the inversion of AD0 during 8-bit cycles, and forced
low for all 16-bit DMA cycles. Table 11 shows the mapping from
the DMA subsystem signals to slot bus signals. Table 12 on
page 96 shows the mapping of the AMD-756 controller DMA
subsystem signals to PCI address bus signals.
Table 11.
DMA Addressing for ISA Bus Accesses (DMA/Slot Bus)
Page Register
Outputs
M[7]
M[6]
M[5]
M[4]
M[3]
M[2]
M[1]
M[0]
Middle Address
Latch Outputs
8237 Address
Outputs
DMA1 ISA Address
Bits
LA[23]
LA[22]
LA[21]
S/LA[20]
S/LA[19]
S/LA[18]
S/LA[17]
S/LA[16]
S/LA[15]
S/LA[14]
S/LA[13]
S/LA[12]
S/LA[11]
S/LA[10]
S/LA[9]
S/LA[8]
S/LA[7]
S/LA[6]
S/LA[5]
S/LA[4]
S/LA[3]
DMA2 ISA Address
Bits
LA[23]
LA[22]
LA[21]
S/LA[20]
S/LA[19]
S/LA[18]
S/LA[17]
—
S/LA[16]
S/LA[15]
S/LA[14]
S/LA[13]
S/LA[12]
S/LA[11]
S/LA[10]
S/LA[9]
S/LA[8]
S/LA[7]
S/LA[6]
S/LA[5]
S/LA[4]
D[7]
D[6]
D[5]
D[4]
D[3]
D[2]
D[1]
D[0]
A[7]
A[6]
A[5]
A[4]
A[3]
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PDF描述 |
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