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參數(shù)資料
| 型號： | AM79C971 |
| 廠商： | Advanced Micro Devices, Inc. |
| 英文描述： | PCnet⑩-FAST Single-Chip Full-Duplex 10/100 Mbps Ethernet Controller for PCI Local Bus |
| 中文描述： | PCnet⑩快速單芯片全雙工10/100 Mbps以太網(wǎng)控制器，PCI總線 |
| 文件頁數(shù)： | 210/265頁 |
| 文件大小： | 3190K |
| 代理商： | AM79C971 |
第1頁第2頁第3頁第4頁第5頁第6頁第7頁第8頁第9頁第10頁第11頁第12頁第13頁第14頁第15頁第16頁第17頁第18頁第19頁第20頁第21頁第22頁第23頁第24頁第25頁第26頁第27頁第28頁第29頁第30頁第31頁第32頁第33頁第34頁第35頁第36頁第37頁第38頁第39頁第40頁第41頁第42頁第43頁第44頁第45頁第46頁第47頁第48頁第49頁第50頁第51頁第52頁第53頁第54頁第55頁第56頁第57頁第58頁第59頁第60頁第61頁第62頁第63頁第64頁第65頁第66頁第67頁第68頁第69頁第70頁第71頁第72頁第73頁第74頁第75頁第76頁第77頁第78頁第79頁第80頁第81頁第82頁第83頁第84頁第85頁第86頁第87頁第88頁第89頁第90頁第91頁第92頁第93頁第94頁第95頁第96頁第97頁第98頁第99頁第100頁第101頁第102頁第103頁第104頁第105頁第106頁第107頁第108頁第109頁第110頁第111頁第112頁第113頁第114頁第115頁第116頁第117頁第118頁第119頁第120頁第121頁第122頁第123頁第124頁第125頁第126頁第127頁第128頁第129頁第130頁第131頁第132頁第133頁第134頁第135頁第136頁第137頁第138頁第139頁第140頁第141頁第142頁第143頁第144頁第145頁第146頁第147頁第148頁第149頁第150頁第151頁第152頁第153頁第154頁第155頁第156頁第157頁第158頁第159頁第160頁第161頁第162頁第163頁第164頁第165頁第166頁第167頁第168頁第169頁第170頁第171頁第172頁第173頁第174頁第175頁第176頁第177頁第178頁第179頁第180頁第181頁第182頁第183頁第184頁第185頁第186頁第187頁第188頁第189頁第190頁第191頁第192頁第193頁第194頁第195頁第196頁第197頁第198頁第199頁第200頁第201頁第202頁第203頁第204頁第205頁第206頁第207頁第208頁第209頁當前第210頁第211頁第212頁第213頁第214頁第215頁第216頁第217頁第218頁第219頁第220頁第221頁第222頁第223頁第224頁第225頁第226頁第227頁第228頁第229頁第230頁第231頁第232頁第233頁第234頁第235頁第236頁第237頁第238頁第239頁第240頁第241頁第242頁第243頁第244頁第245頁第246頁第247頁第248頁第249頁第250頁第251頁第252頁第253頁第254頁第255頁第256頁第257頁第258頁第259頁第260頁第261頁第262頁第263頁第264頁第265頁
210
Am79C971
SWITCHING CHARACTERISTICS: EXTERNAL ADDRESS DETECTION INTERFACE
Note:
1. May need to delay RX_CLK to capture Start Frame Byte Delimiter (SFBD) at 100 Mbps operation.
Parameter
Symbol
External Address Detection Interface: Internal PHY
t
EAD1
SRD setup to
↑
SRDCLK
t
EAD2
SRD hold to
↑
SRDCLK
t
EAD3
SFBD# change to
↓
SRDCLK
EAR deassertion to
↑
SRDCLK (first
rising edge)
EAR assertion after SFD event
(frame rejection)
t
EAD6
EAR assertion width
External Address Detection Interface: External PHY - MII @ 25 MHz
t
EAD7
SFBD change from
↓
RX_CLK
EAR deassertion to
↑
RX_CLK (first
rising edge)
EAR assertion after SFD event
(frame rejection)
t
EAD10
EAR assertion width
External Address Detection Interface: External PHY - MII @ 2.5 MHz
EAR deassertion to
↑
RX_CLK (first
rising edge)
EAR assertion after SFD event
(frame rejection)
t
EAD13
EAR assertion width
Receive Frame Tag Timing with Media Independent Interface
RXFRTGE assertion from
↑
SFBD
(first rising edge)
RXFRTGE, RXFRTGD setup to
↑
RX_CLK
RXFRTGE, RXFRTGD hold to
↑
RX_CLK
Parameter Name
Test Condition
Min
Max
Unit
40
40
-15
ns
ns
ns
+15
t
EAD4
50
ns
t
EAD5
0
51,090
ns
110
ns
0
20 (Note 1) ns
t
EAD8
40
ns
t
EAD9
0
5,080
ns
50
ns
t
EAD11
400
ns
t
EAD12
0
50,800
ns
500
ns
t
EAD14
0
ns
t
EAD15
10
ns
t
EAD16
10
ns
t
EAD17
RXFRTGE deassertion to
↓
RX_DV
RX_CLK @25 MHz
RX_CLK @2.5 MHz
40
400
ns
ns
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PDF描述 |
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