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參數(shù)資料
| 型號(hào)： | 79RC32V333-133DH |
| 英文描述： | 8-pin, 1.5KB Flash Program, 64B Flash Data, 8MHz Internal Oscillator, -40C to +85C, 8-SOIC 150mil, T/R |
| 中文描述： | 微處理器 |
| 文件頁(yè)數(shù)： | 481/654頁(yè) |
| 文件大?。?/td> | 6963K |
| 代理商： | 79RC32V333-133DH |
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IDT EJTAG System
EJTAG Processor Core Extensions
79RC32438 User Reference Manual
20 - 15
November 4, 2002
Notes
General Debug Exception Processing
All debug exceptions have the same basic processing flow:
The DEPC register is loaded with the PC at which execution can be restarted, and the DBD bit is
set to indicate whether the last debug exception occurred in a branch delay slot. The value loaded
into the DEPC register is either the current PC (if the instruction is not in the delay slot of a branch)
or the PC of the branch or jump (if the instruction is in the delay slot of a branch or jump).
The DSS, DBp, DDBL, DDBS, DIB, DINT, DDBLImpr, and DDBSImpr bits in the Debug register are
updated appropriately depending on the debug exception.
DExcCode field in the Debug register is undefined.
Halt and Doze bits in the Debug register are updated appropriately.
IEXI bit is set to inhibit imprecise exceptions in the start of the debug handler.
DM bit in the Debug register is set to 1.
The processor begins fetching instructions from the debug exception vector.
The value loaded into the DEPC register represents the restart address from the debug exception and
does not need to be modified by the debug exception handler software. Debug software need only look at
the DBD bit in the Debug register if it wishes to identify the address of the instruction that actually caused a
precise debug exception.
The DSS, DBp, DDBL, DDBS, DIB, DINT, DDBLImpr, and DDBSImpr bits in the Debug register indicate
the occurrence of distinct debug exceptions, except when a Debug Data Break Load/Store Imprecise
exception occurs (see section “Debug Data Break Load/Store Imprecise Exception” on page 20-17). Note
that occurrence of an exception while in Debug mode will clear these bits. The handler can thereby deter-
mine whether an debug exception or an exception in Debug Mode occurred. No other CP0 registers or
fields are changed due to the debug exception, thus no additional state is saved. The overall exception
processing flow is shown below:
Operation
:
if (InstructionInBranchDelaySlot) then
DEPC ¨ BranchInstructionPC
DebugDBD ¨ 1
else
DEPC ¨ PC
DebugDBD ¨ 0
endif
DebugDSS, DBp, DDBL, DDBS, DIB, DINT, DDBLImpr and DDBSImpr ¨ DebugExceptionType
DebugDExcCode ¨ UNPREDICTABLE
DebugHalt ¨ HaltStatusAtDebugException
DebugDoze ¨ DozeStatusAtDebugException
DebugIEXI ¨ 1
ProbTrap bit in ECR
Register
Debug Exception
Vector Address
0
0xBFC0 0480
1
0xFF20 0200 in dmseg
Table 20.13 Debug Exception Vector Location
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| 79RC32V333-133DHI | Microprocessor |
| 79RC32V333-150DH | 8 PIN, 1.75KB, FLASH, 64B RAM, COMPARATOR, 8MHZ INTERNAL OSCILLATOR, -40C to +125C, 8-PDIP, TUBE |
| 79RC32V333-150DHI | Microprocessor |
| 79RC32V334-100BB | MICROPROCESSOR|32-BIT|BGA|256PIN|PLASTIC |
| 79RC32V334-100BBI | MICROPROCESSOR|32-BIT|BGA|256PIN|PLASTIC |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| 79RC32V333-133DHI | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Microprocessor |
| 79RC32V333-150DH | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Microprocessor |
| 79RC32V333-150DHI | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Microprocessor |
| 79RC32V334-100BB | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:MICROPROCESSOR|32-BIT|BGA|256PIN|PLASTIC |
| 79RC32V334-100BBG | 制造商:Integrated Device Technology Inc 功能描述:MPU RC32300 32-Bit 100MHz 3.3V 256-Pin BGA |
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