參數(shù)資料
型號(hào)： 79RC32V333-133DH
英文描述： 8-pin, 1.5KB Flash Program, 64B Flash Data, 8MHz Internal Oscillator, -40C to +85C, 8-SOIC 150mil, T/R
中文描述： 微處理器
文件頁(yè)數(shù)： 186/654頁(yè)
文件大小： 6963K
代理商： 79RC32V333-133DH
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IDT Device Controller
Theory of Operation
79RC32438 User Reference Manual
6 - 2
November 4, 2002
Notes
Theory of Operation
The following memory and peripheral bus signals are managed by the device controller during device
transactions:
–
MADDR[25:0] (address bus, MADDR[21:0] directly available as I/O pins, MADDR[25:22] are
GPIO alternate functions)
–
MDATA[15:0] (data bus)
–
OEN (output enable, may be used as Intel style read signal)
–
BWEN[1:0] (byte write enables, may be used as Intel style write signals)
–
RWN (Motorola style read/write signal)
–
CSN[5:0] (chip selects)
–
WAITACKN (configurable as Intel style wait signal or Motorola style transfer acknowledge signal)
–
BOEN (external data bus buffer output enable)
–
BDIRN (external data bus buffer direction).
All memory and peripheral bus transactions are synchronous to the master clock (EXTCLK). Therefore,
all of the timing parameters in the Device Control (DEVxC) and Device Timing Control (DEVxTC) registers
are in terms of master clock (EXTCLK) clock cycles.
0x01_0024
DEV2MASK
Device 2 Mask
32-bit
0x01_0028
DEV2C
Device 2 Control
32-bit
0x01_002C
DEV2TC
Device 2 Timing control
32-bit
0x01_0030
DEV3BASE
Device 3 Base
32-bit
0x01_0034
DEV3MASK
Device 3 Mask
32-bit
0x01_0038
DEV3C
Device 3 Control
32-bit
0x01_003C
DEV3TC
Device 3 Timing control
32-bit
0x01_0040
DEV4BASE
Device 4 Base
32-bit
0x01_0044
DEV4MASK
Device 4 Mask
32-bit
0x01_0048
DEV4C
Device 4 Control
32-bit
0x01_004C
DEV4TC
Device 4 Timing control
32-bit
0x01_0050
DEV5BASE
Device 5 Base
32-bit
0x01_0054
DEV5MASK
Device 5 Mask
32-bit
0x01_0058
DEV5C
Device 5 Control
32-bit
0x01_005C
DEV5TC
Device 5 Timing control
32-bit
0x01_0060
BTCS
Bus Timer Control and Status
32-bit
0x01_0064
BTCOMPARE
Bus Transaction Timer Compare
32-bit
0x01_0068
BTADDR
Bus Transaction Timer Address
32-bit
0x01_006C
DEVDACS
Device Decoupled Access Control and
Status
32-bit
0x01_0070
DEVDAA
Device Decoupled Access Address
32-bit
0x01_0074
DEVDAD
Device Decoupled Access Data
32-bit
0x01_0078 through 0x01_7FFF
Reserved
1.
The address of the register is equal to the register offset added to the base value of 0x1800_0000.
Register Offset
1
Register Name
Register Function
Size
Table 6.1 Device Controller Register Map
相關(guān)PDF資料
PDF描述
79RC32V333-133DHI Microprocessor
79RC32V333-150DH 8 PIN, 1.75KB, FLASH, 64B RAM, COMPARATOR, 8MHZ INTERNAL OSCILLATOR, -40C to +125C, 8-PDIP, TUBE
79RC32V333-150DHI Microprocessor
79RC32V334-100BB MICROPROCESSOR|32-BIT|BGA|256PIN|PLASTIC
79RC32V334-100BBI MICROPROCESSOR|32-BIT|BGA|256PIN|PLASTIC
相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
79RC32V333-133DHI 制造商:未知廠(chǎng)家 制造商全稱(chēng):未知廠(chǎng)家 功能描述:Microprocessor
79RC32V333-150DH 制造商:未知廠(chǎng)家 制造商全稱(chēng):未知廠(chǎng)家 功能描述:Microprocessor
79RC32V333-150DHI 制造商:未知廠(chǎng)家 制造商全稱(chēng):未知廠(chǎng)家 功能描述:Microprocessor
79RC32V334-100BB 制造商:未知廠(chǎng)家 制造商全稱(chēng):未知廠(chǎng)家 功能描述:MICROPROCESSOR|32-BIT|BGA|256PIN|PLASTIC
79RC32V334-100BBG 制造商:Integrated Device Technology Inc 功能描述:MPU RC32300 32-Bit 100MHz 3.3V 256-Pin BGA
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