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參數(shù)資料
| 型號： | 79RC32V333-133DH |
| 英文描述： | 8-pin, 1.5KB Flash Program, 64B Flash Data, 8MHz Internal Oscillator, -40C to +85C, 8-SOIC 150mil, T/R |
| 中文描述： | 微處理器 |
| 文件頁數(shù)： | 197/654頁 |
| 文件大?。?/td> | 6963K |
| 代理商： | 79RC32V333-133DH |
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IDT Device Controller
Device Read Transaction
79RC32438 User Reference Manual
6 - 13
November 4, 2002
Notes
When configured as a wait signal, WAITACKN must be asserted at least two clock cycles prior to the
end of
RWS.
WAITACKN assertions after this point are ignored. Thus, to use WAITACKN in this mode
RWS
must have a value greater than or equal to three.
Figure 6.10 Device Read Transaction
1
(WAITACKN Configured As Wait)
The WAITACKN signal may be configured as an Intel style wait signal or as a Motorola style transfer
acknowledge signal. Up to this point, this section has only considered WAITACKN configured as a wait
signal. When WAITACKN is configured as transfer acknowledge, then the read wait states (
RWS
) value is
ignored and the assertion of WAITACKN signals the completion of the transaction.
Figure 6.11 Device Read Transaction
1
(WAITACKN Configured As Transfer Acknowledge)
The device read transaction, with WAITACKN configured as a transfer acknowledge input, consists of
the following steps.
1. The RC32438 drives the address bus (MADDR[25:0]), drives RWN high and BDIRN low, and asserts
BOEN
2
on the rising edge of EXTCLK. This indicates the start of a transaction.
2.
CSD
clock cycles after step one, the RC32438 asserts the appropriate chip select (CSNx).
3.
OED
clock cycles after step one, the RC32438 asserts output enable (OEN).
4. The external device asserts WAITACKN once it has driven valid data onto the data bus and is ready
for the transaction to complete.
1.
The programmable parameters shown in this figure are for illustrative purposes only and may be varied.
2.
BOEN is only asserted if the buffer enable (BE) bit is set in the device control register (DEVxC).
EXTCLK
MADDR[25:0]
RWN
CSNx
BWEN[1:0]
OEN
MDATA[15:0]
Transaction
CSD
OED
RWS
CSH
Address Valid
Data Valid
Transaction
PRD
BOEN
WAITACKN
EXTCLK
MADDR[25:0]
RWN
CSNx
BWEN[1:0]
OEN
MDATA[15:0]
Transaction
CSD
OED
PRD
CSH
Address Valid
Data Valid
Transaction
BOEN
WAITACKN
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| 79RC32V333-133DHI | Microprocessor |
| 79RC32V333-150DH | 8 PIN, 1.75KB, FLASH, 64B RAM, COMPARATOR, 8MHZ INTERNAL OSCILLATOR, -40C to +125C, 8-PDIP, TUBE |
| 79RC32V333-150DHI | Microprocessor |
| 79RC32V334-100BB | MICROPROCESSOR|32-BIT|BGA|256PIN|PLASTIC |
| 79RC32V334-100BBI | MICROPROCESSOR|32-BIT|BGA|256PIN|PLASTIC |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| 79RC32V333-133DHI | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Microprocessor |
| 79RC32V333-150DH | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Microprocessor |
| 79RC32V333-150DHI | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Microprocessor |
| 79RC32V334-100BB | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:MICROPROCESSOR|32-BIT|BGA|256PIN|PLASTIC |
| 79RC32V334-100BBG | 制造商:Integrated Device Technology Inc 功能描述:MPU RC32300 32-Bit 100MHz 3.3V 256-Pin BGA |
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