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參數(shù)資料
| 型號(hào)： | μPD30102 |
| 廠商： | NEC Corp. |
| 英文描述： | 64-/32-BIT Microprocessor(64/32位微處理器) |
| 中文描述： | 64-/32-BIT微處理器（64/32位微處理器） |
| 文件頁(yè)數(shù)： | 24/112頁(yè) |
| 文件大小： | 639K |
| 代理商： | ΜPD30102 |
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μ
PD30102
24
Preliminary Data Sheet
3. INTERNAL ARCHITECTURE
3.1 Pipeline
Each instruction is executed in the following five steps:
(1) IF
(2) RF
(3) EX
(4) DC
(5) WB
Instruction fetch
Register fetch
Execution
Data cache fetch
Write back
The V
R
4102 has a five-stage pipeline. It takes five clocks to execute each instruction, but instructions can be executed
in parallel. The pipeline clock, PClock, is determined by the setting of the CLKSEL (0:2) pins.
The following figure outlines the pipeline.
Figure 3-1. Pipeline of V
R
4102 (5-stage)
PClock (internal)
IF
RF
EX
DC
WB
IF
RF
EX
DC
WB
IF
RF
EX
DC
WB
IF
RF
EX
DC
WB
IF
RF
EX
DC
WB
Current
CPU
cycle
相關(guān)PDF資料 |
PDF描述 |
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參數(shù)描述 |
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