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參數(shù)資料
| 型號： | UPD46128512F9-CR2 |
| 廠商： | NEC Corp. |
| 英文描述： | 128M-BIT CMOS MOBILE SPECIFIED RAM 8M-WORD BY 16-BIT EXTENDED TEMPERATURE OPERATION |
| 中文描述： | 128兆位CMOS移動指明內存800萬字由16位溫度范圍 |
| 文件頁數(shù)： | 63/82頁 |
| 文件大小： | 817K |
| 代理商： | UPD46128512F9-CR2 |
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Preliminary Data Sheet M17507EJ2V0DS
63
μ
PD46128512-X
Figure 8-6. Synchronous Burst Read Suspend Timing Chart
T0
T1
T2
T3
T4
T5
T6
T7
T8
T9
T10
CLK (Input)
/ADV (Input)
Address (Input)
/CE1 (Input)
/WAIT (Output)
/OE (Input)
DQ (Output)
/LB, /UB (Input)
/WE (Input)
t
CH
t
CL
Q0
t
ACS
t
BACC
t
BDH
t
BACC
t
BDH
t
CEWA
t
CLWA
t
CSV
t
VPL
t
CHCL
t
CHCL
t
CLZ
t
OLZ
t
OC
t
BLZ
t
BC
t
SOP
t
CES
t
ACH
t
CHV
t
AH
RL = 5
t
CHV
t
CYCLE
Q1
Q2
Q3
Q4
High-Z
High-Z
Valid
High-Z
H
t
SOEH
t
SOES
t
SOEH
t
SOES
Remarks 1.
The above timing chart assumes Read Latency is 5 and Burst Length is 8 or 16.
2.
CE2 should be fixed HIGH.
3.
Valid clock edge is the rising edge.
4.
t
OC
and t
BC
are defined from CLK rising edge of RL
1 to /OE = LOW, /LB and /UB = LOW.
5.
Burst read suspend is valid after outputting the first read access data (Q0).
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