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參數資料
| 型號： | UPD46128512F9-CR2 |
| 廠商： | NEC Corp. |
| 英文描述： | 128M-BIT CMOS MOBILE SPECIFIED RAM 8M-WORD BY 16-BIT EXTENDED TEMPERATURE OPERATION |
| 中文描述： | 128兆位CMOS移動指明內存800萬字由16位溫度范圍 |
| 文件頁數： | 40/82頁 |
| 文件大?。?/td> | 817K |
| 代理商： | UPD46128512F9-CR2 |
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Preliminary Data Sheet M17507EJ2V0DS
40
μ
PD46128512-X
Figure 7-5. Asynchronous Read Cycle Timing Chart 3 (/CE1 Controlled)
/CE1 (Input)
Address (Input)
Data Out Q2
DQ (Output)
High-Z
High-Z
High-Z
t
RC
/OE (Input)
L
L
Data Out Q1
t
RC
t
ACE
t
ACE
t
CP
A1
A2
A3
t
CP
t
CLZ
t
CLZ
t
CHZ
t
CHZ
t
CHAH
t
CHAH
/LB, /UB (Input)
t
ASC
t
ASC
Cautions 1. In read cycle, CE2 and /WE should be fixed HIGH.
2. /ADV should be fixed LOW or toggled HIGH
→
LOW
→
HIGH. CLK should be fixed HIGH or LOW.
Figure 7-6. Asynchronous Read Cycle Timing Chart 4 (/OE Controlled)
/CE1 (Input)
Address (Input)
Data Out Q2
DQ (Output)
High-Z
High-Z
High-Z
t
RC
/OE (Input)
t
ASO
Data Out Q1
t
OE
t
RC
t
AA
t
ASO
t
OE
t
ASO
t
OP
t
OP
A1
A2
A3
t
OHZ
t
OLZ
t
OHZ
t
OLZ
t
OHAH
t
OHAH
t
AA
/LB, /UB (Input)
L
Cautions 1. In read cycle, CE2 and /WE should be fixed HIGH.
2. /ADV should be fixed LOW or toggled HIGH
→
LOW
→
HIGH. CLK should be fixed HIGH or LOW.
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PDF描述 |
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參數描述 |
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