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參數(shù)資料
| 型號(hào)： | TECO3264 |
| 廠商： | Lineage Power |
| 英文描述： | 32-Channel Echo Canceller(32通道回波清除器) |
| 中文描述： | 32通道回聲消除器（32通道回波清除器） |
| 文件頁數(shù)： | 24/128頁 |
| 文件大?。?/td> | 2328K |
| 代理商： | TECO3264 |
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Data Sheet
August 1999
TECO3264 32-Channel Echo Canceller
24
Lucent Technologies Inc.
External Control Connection
(continued)
PCM Input/Output (I/O) Timing and Register Control
(continued)
PCM Offset Programming
To facilitate bit offset programming calculations, two variables are introduced: clock-edge transmit (CET) which
refers to the clock edge of transmission of the first bit of the first time slot, and clock-edge receive (CER) refers to
the clock edge on which the first received bit is sampled. CET and CER are counted with respect to the edge on
which the SYNC clock is sampled. Values of CER and CET depend upon the values of the parameters described
above. If [X, Y]RCE = 1 and [C, E]XCE = 1 are chosen in Figure 11 on page 22, then CER = 12 and CET = 8. Sim-
ilarly, if [X, Y]RCE = 1 and [C, E]XCE = 0, then CER = 12 and CET = 10. Table 3 and Table 4 show the relationship
between CET and CER for both CMS cases. It is important to remember that received data is sampled in the mid-
dle of the data bit.
Table 3. Relationship Between CET and CER, When CMS = 1
Table 4. Relationship Between CET and CER, When CMS = 0
[X, Y]XCE
0
0
1
1
[C, E]RCE
0
1
0
1
CER = CET + CK8M Edges
CET + 4
CET + 6
CET + 2
CET + 4
FE
0
0
0
0
1
1
1
1
[X, Y]XCE
0
0
1
1
0
0
1
1
[C, E]RCE
0
1
0
1
0
1
0
1
CER = CET + CK8M Edges
CET
CET + 2
CET + 2
CET + 4
CET + 4
CET + 2
CET + 6
CET + 4
相關(guān)PDF資料 |
PDF描述 |
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