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參數(shù)資料
| 型號： | STLC1502 |
| 廠商： | 意法半導(dǎo)體 |
| 英文描述： | VOICE OVER IP PROCESSOR |
| 中文描述： | IP語音處理器 |
| 文件頁數(shù)： | 43/81頁 |
| 文件大?。?/td> | 526K |
| 代理商： | STLC1502 |
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STLC1502
7.5.4 Collision management
Collision is defined as a write of the DR register while the internal serial clock (SCK) is in the process of
transfer. The WCOL bit in the SR register is set if a write collision occurs. No SPI interrupt is generated
when the WCOL bit is set (the WCOL bit is a status flag only). Clearing the WCOL bit is done through a
software sequence:
1-Read SR
2-Read DR
7.5.5 SPI register map [0x0C280000]
The base address of the Remap & Pause register is 0x0C280000.
相關(guān)PDF資料 |
PDF描述 |
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參數(shù)描述 |
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| STLC1511 | 制造商:STMICROELECTRONICS 制造商全稱:STMicroelectronics 功能描述:NorthenLite⑩ G.lite BiCMOS Analog Front-End Circuit |
| STLC1512 | 制造商:STMICROELECTRONICS 制造商全稱:STMicroelectronics 功能描述:NorthenLite⑩ G.lite BiCMOS Analog Front-End Circuit |
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