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參數(shù)資料
| 型號： | SAA7115 |
| 廠商： | NXP Semiconductors N.V. |
| 英文描述： | PAL/NTSC/SECAM Video Decoder with Adaptive PAL/NTSC Comb Filter, High Performance Scaler, I2C Sliced Data Readback and SQ PIXEL OUTPUT |
| 中文描述： | PAL / NTSC制式/ SECAM視頻解碼器，自適應(yīng)PAL / NTSC制式梳狀濾波器，高性能潔牙機(jī)，刨切的I2C數(shù)據(jù)回讀和SQ像素輸出 |
| 文件頁數(shù)： | 84/214頁 |
| 文件大?。?/td> | 732K |
| 代理商： | SAA7115 |
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Pemnr
NAeue
Filename:
SAA7115_Datasheet.fm
Confidential - NDA required
page 84
Last edited by H. Lambers
Philips Semiconductors
CS-PD Hamburg
CVIP2
Datasheet
SAA7115
Date:
10/23/01
Version:
0.67
Table 29
Programming examples for ASCLK/ALRCLK clock generation
8.7.2
A
UDIO CLOCK GENERATION WITH ANALOG
PLL (CGC2)
SUPPORT
When generating the Audio clock using the second analog PLL (CGC2) the CGC2 is driven by the digital Audio Clock
PLL. The Output of CGC2 again is output at the audio master clock output pin AMCLK (pin 37) controlled by the UCGC
(address 3A H [7]) programming register. For audio clock frequencies of 512 * fs, with fs = 48.0 KHz or 44.1 KHz this is
already the low jitter audio clock. All other low jitter audio clocks are output at the ASCLK pin (pin 39) using the internal
divider controlled by SDIV (address 38 H [5:0]) programming register (refer to table 30 and 31). Therefore the audio
master clock AMCLK must be returned into the device via the AMXCLK pin (pin 41).
The audio master clock again is synthesized from the same crystal frequency as the line-locked video clock and is
defined as:
Audio master Clocks Per Field, ACPF[17:0] 32H[1:0] 31H[7:0] 30H[7:0] according to the equation:
Audio master Clocks Nominal Increment, ACNI[21:0] 36H[5:0] 35H[7:0] 34H[7:0] according to the equation:
Note that in this case the audio master clock is not identical to the clock output by the digital audio clock PLL any more.
The second analog PLL (CGC2) operates at a centre frequency of 36 MHz if CGCDIV (register address 3A H [6]) is set
to 1 and 27 MHz if CGCDIV is set to 0. CGC2 can operate in a range of -18% and +15.8% around these centre
frequencies.
AMXCLK
(MHz)
ASCLK
(kHz)
SDIV
ALRCLK
(kHz)
LRDIV
DECIMAL
HEX
DECIMAL
HEX
12.288
1536
768
1411.2
2822.4
1024
2048
3
7
3
1
3
1
03
07
03
01
03
01
48
16
8
16
32
16
32
10
08
10
10
10
10
11.2896
44.1
8.192
32
ACPF[17:0]
round
audio master clock frequency
field frequency
-----------------------------------------------------------------------------
4
CGCDIV
16
–
(
---------------------------------------
)
=
ACNI[21:0]
round
audio crystal frequency
2
23
×
CGCDIV
16
–
-4
)
=
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| SAA7116 | Digital Video to PCI Interface |
| SAA7116H | Video Converter Circuit |
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參數(shù)描述 |
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| SAA7115AHL/V1,518 | 功能描述:視頻 IC 9-BIT VIDEO DECODER RoHS:否 制造商:Fairchild Semiconductor 工作電源電壓:5 V 電源電流:80 mA 最大工作溫度:+ 85 C 封裝 / 箱體:TSSOP-28 封裝:Reel |
| SAA7115AHL/V1,557 | 功能描述:視頻 IC 9-BIT VIDEO DECODER RoHS:否 制造商:Fairchild Semiconductor 工作電源電壓:5 V 電源電流:80 mA 最大工作溫度:+ 85 C 封裝 / 箱體:TSSOP-28 封裝:Reel |
| SAA7115AHL/V1-T | 功能描述:視頻 IC 9-BIT VIDEO DECODER RoHS:否 制造商:Fairchild Semiconductor 工作電源電壓:5 V 電源電流:80 mA 最大工作溫度:+ 85 C 封裝 / 箱體:TSSOP-28 封裝:Reel |
| SAA7115HL/V1 | 制造商:NXP Semiconductors 功能描述:IC VIDEO DECODR DIGITAL 100 |
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