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參數(shù)資料
| 型號： | SAA7115 |
| 廠商： | NXP Semiconductors N.V. |
| 英文描述： | PAL/NTSC/SECAM Video Decoder with Adaptive PAL/NTSC Comb Filter, High Performance Scaler, I2C Sliced Data Readback and SQ PIXEL OUTPUT |
| 中文描述： | PAL / NTSC制式/ SECAM視頻解碼器，自適應(yīng)PAL / NTSC制式梳狀濾波器，高性能潔牙機(jī)，刨切的I2C數(shù)據(jù)回讀和SQ像素輸出 |
| 文件頁數(shù)： | 49/214頁 |
| 文件大?。?/td> | 732K |
| 代理商： | SAA7115 |
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Pemnr
Each programming page contains control:
NAeue
Filename:
SAA7115_Datasheet.fm
Confidential - NDA required
page 49
Last edited by H. Lambers
Philips Semiconductors
CS-PD Hamburg
CVIP2
Datasheet
SAA7115
Date:
10/23/01
Version:
0.67
8.3
Scaler
The high performance video scaler in the SAA7115 has the following major blocks:
Acquisition control (horizontal and vertical timer) and task handling (the region/field/frame based processing)
Prescaler, for horizontal down-scaling by an integer factor, combined with appropriate band limiting filters, especially
anti-aliasing for CIF format
Line buffer, with asynchronous read and write, to support vertical up-scaling (e.g. for videophone application,
converting 240 into 288 lines, Y-C
B
-C
R
4 : 2 : 2)
Vertical scaling, with phase accurate Linear Phase Interpolation (LPI) for zoom and downscale, or phase accurate
Accumulation Mode (ACM) for large downscaling ratios and better alias suppression
Variable Phase Delay (VPD), operates as horizontal phase accurate interpolation for arbitrary non-integer scaling
ratios, supporting conversion between square and rectangular pixel sampling
Output formatter for scaled Y-C
B
-C
R
4 : 2 : 2, Y-C
B
-C
R
4 : 1 : 1 and Yonly (format also for raw data)
FIFO, 32-bit wide, with 64 pixel capacity in Y-C
B
-C
R
formats
Output interface, 8 or 16-bit (only if extended by H-port) data pins wide, synchronous or asynchronous operation, with
stream events on discrete pins, or coded in the data stream.
The overall H and V zooming (HV_zoom) is restricted by the input/output data rate relationships. With a safety margin of
2% for running in and running out,
T_input_field
in_pixel
in_lines
×
the maximum HV_zoom is equal to:
For example:
1.
Input from decoder: 50 Hz, 720 pixel, 288 lines, 16-bit data at 13.5 MHz data rate, 1 cycle per pixel; output: 8-bit data
at 27 MHz, 2 cycles per pixel;
20 ms
24
×
–
720
288
×
2
×
×
the maximum HV_zoom is about:
2.
Input from X-port: 60 Hz, 720 pixel, 240 lines, 8-bit data at 27 MHz data rate (ITU 656), 2 cycles per pixel; output via
I + H-port: 16-bit data at 27 MHz clock, 1 cycle per pixel;
22
×
–
240
×
1
×
×
the maximum HV_zoom is about:
The data flow in the scaler is controlled by internal data valid and data request flags (internal handshake signalling)
between the sub-blocks, as the scaling process itself is discontinuous and dynamical. Therefore the entire scaler acts as
a pipeline buffer. Depending on the actually programmed scaling parameters the effective buffer can exceed to an entire
line. This allows vertical upscaling, more flexible video stream timing at the image port, discontinuous transfers and
handshake. The access/bandwidth requirements to the VGA frame buffer are reduced significantly.
The video scaler receives its input signal from the video decoder or from the expansion port (X-port). It gets 16-bit
Y-C
B
-C
R
4 : 2 : 2 input data at a continuous rate of 13.5 MHz from the decoder. Discontinuous data stream can be
accepted from the expansion port (X-port), normally 8-bit wide ITU 656 like Y-C
B
-C
R
data, accompanied by a pixel
qualifier on XDQ.
The input data stream is sorted into two data paths, one for luminance (or raw samples) and one for time multiplexed
chrominance C
B
and C
R
samples. An Y-C
B
-C
R
4 : 1 : 1 input format from the X-port is converted to 4 : 2 : 2 for the
horizontal prescaling and vertical filter scaling operation.
The scaler operation is defined by two programming pages A and B, representing two different tasks, that can be applied
field alternating or to define two regions in a field (e.g. with different scaling range, factors and signal source during odd
and even fields).
0.98
T_v_blanking
out_cycle_per_pix
–
×
T_out_clk
×
×
0.98
μ
s
37 ns
-------------------------------------64
1.18
=
×
0.98
64
μ
s
37 ns
720
2.34
=
×
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| SAA7116 | Digital Video to PCI Interface |
| SAA7116H | Video Converter Circuit |
| SAA7145 | |
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參數(shù)描述 |
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| SAA7115AHL/V1,518 | 功能描述:視頻 IC 9-BIT VIDEO DECODER RoHS:否 制造商:Fairchild Semiconductor 工作電源電壓:5 V 電源電流:80 mA 最大工作溫度:+ 85 C 封裝 / 箱體:TSSOP-28 封裝:Reel |
| SAA7115AHL/V1,557 | 功能描述:視頻 IC 9-BIT VIDEO DECODER RoHS:否 制造商:Fairchild Semiconductor 工作電源電壓:5 V 電源電流:80 mA 最大工作溫度:+ 85 C 封裝 / 箱體:TSSOP-28 封裝:Reel |
| SAA7115AHL/V1-T | 功能描述:視頻 IC 9-BIT VIDEO DECODER RoHS:否 制造商:Fairchild Semiconductor 工作電源電壓:5 V 電源電流:80 mA 最大工作溫度:+ 85 C 封裝 / 箱體:TSSOP-28 封裝:Reel |
| SAA7115HL/V1 | 制造商:NXP Semiconductors 功能描述:IC VIDEO DECODR DIGITAL 100 |
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