參數(shù)資料
型號： S71WS512NC0BAWA62
廠商： Spansion Inc.
英文描述： Stacked Multi-Chip Product (MCP)
中文描述： 堆疊式多芯片產(chǎn)品（MCP）
文件頁數(shù)： 170/188頁
文件大小： 2252K
代理商： S71WS512NC0BAWA62
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168
S71WS-Nx0 Based MCPs
S71WS-N_01_A4 September 15, 2005
A d v a n c e I n f o r m a t i o n
47.3.1.3
MRSE = V
IH
, OE# = V
IH
, WAIT# = High-Z, WE# Controlled\
Multiple W rite Cycle ( Low ADV# Type)
Notes:
1.
2.
Low ADV# type multiple write cycle.
A write occurs during the overlap (t
) of low CS# and low WE#. A write begins when CS# goes low and WE# goes
low with asserting UB# or LB# for single byte operation or simultaneously asserting UB# and LB# for double byte
operation. A write ends at the earliest transition when CS# goes high or WE# goes high. The t
WP
is measured from the
beginning of write to the end of write.
t
CW
is measured from the CS# going low to the end of write.
t
AS
is measured from the address valid to the beginning of write.
t
is measured from the end of write to the address change. t
WR
is applied in case a write ends with CS# or WE#
going high.
Clock input does not have any affect on the asynchronous multiple write operation if t
WHP
is shorter than the (Read
Latency - 1) clock duration.
t
WP(min)
= 70ns for continuous write operation over 50 times.
Figure 47.9 Timing Waveform Of Multiple Write Cycle (Low ADV# Type)
3.
4.
5.
6.
7.
Table 47.8 Asynchronous Write in Synchronous Mode AC Characteristics
Notes:
1.
2.
Low ADV# type multiple write, WE# Controlled.
t
WP(min)
= 70ns for continuous write operation over 50 times.
Symbol
Speed
Units
Symbol
Speed
Units
Min
70
60
60
60
Max
—
—
—
—
—
Min
5ns
0
0
30
0
Max
t
WC
t
CW
t
AW
t
BW
t
WP
ns
t
WHP
t
AS
t
WR
t
DW
t
DH
Latency-1 clock
—
—
—
—
—
ns
55 (note 2)
Address
DataValid
WE#
Data in
t
WC
t
CW
t
BW
t
WP
t
DH
t
DW
t
WR
t
AW
t
AS
CS#
ADV#
Data out
High-Z
High-Z
1
2
3
4
5
6
7
8
9
CLK
0
10
11
12
13
t
WC
t
AS
t
WR
Data Valid
t
DH
t
DW
t
WHP
t
WP
t
CW
t
AW
t
BW
14
UB#, LB#
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PDF描述
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