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參數(shù)資料
| 型號： | PEF22508E |
| 廠商： | INFINEON TECHNOLOGIES AG |
| 元件分類： | 數(shù)字傳輸電路 |
| 英文描述： | DATACOM, PCM TRANSCEIVER, PBGA256 |
| 封裝： | 17 X 17 MM, 1 MM PITCH, PLASTIC, LBGA-256 |
| 文件頁數(shù)： | 140/193頁 |
| 文件大?。?/td> | 10683K |
| 代理商： | PEF22508E |
第1頁第2頁第3頁第4頁第5頁第6頁第7頁第8頁第9頁第10頁第11頁第12頁第13頁第14頁第15頁第16頁第17頁第18頁第19頁第20頁第21頁第22頁第23頁第24頁第25頁第26頁第27頁第28頁第29頁第30頁第31頁第32頁第33頁第34頁第35頁第36頁第37頁第38頁第39頁第40頁第41頁第42頁第43頁第44頁第45頁第46頁第47頁第48頁第49頁第50頁第51頁第52頁第53頁第54頁第55頁第56頁第57頁第58頁第59頁第60頁第61頁第62頁第63頁第64頁第65頁第66頁第67頁第68頁第69頁第70頁第71頁第72頁第73頁第74頁第75頁第76頁第77頁第78頁第79頁第80頁第81頁第82頁第83頁第84頁第85頁第86頁第87頁第88頁第89頁第90頁第91頁第92頁第93頁第94頁第95頁第96頁第97頁第98頁第99頁第100頁第101頁第102頁第103頁第104頁第105頁第106頁第107頁第108頁第109頁第110頁第111頁第112頁第113頁第114頁第115頁第116頁第117頁第118頁第119頁第120頁第121頁第122頁第123頁第124頁第125頁第126頁第127頁第128頁第129頁第130頁第131頁第132頁第133頁第134頁第135頁第136頁第137頁第138頁第139頁當(dāng)前第140頁第141頁第142頁第143頁第144頁第145頁第146頁第147頁第148頁第149頁第150頁第151頁第152頁第153頁第154頁第155頁第156頁第157頁第158頁第159頁第160頁第161頁第162頁第163頁第164頁第165頁第166頁第167頁第168頁第169頁第170頁第171頁第172頁第173頁第174頁第175頁第176頁第177頁第178頁第179頁第180頁第181頁第182頁第183頁第184頁第185頁第186頁第187頁第188頁第189頁第190頁第191頁第192頁第193頁
OctalLIU
TM
PEF 22508 E
Functional Description
Data Sheet
50
Rev. 1.0, 2005-06-02
Figure 14
Interrupt Status Registers
Each interrupt indication bit of the registers ISR can be selectively masked by setting the corresponding bit in the
corresponding mask registers IMR. If the interrupt status bits are masked they neither generate an interrupt at INT
nor are they visible in ISR. All reserved bits in the mask registers IMR must not be written with the value 0.
GIS, the non-maskable “Global” Interrupt Status Register per channel, serves as pointer to pending interrupts
sourced by registers ISR(1:4), ISR6 and ISR7.
The non-maskable Channel Interrupt Status Register CIS serves as channel pointer to pending interrupts sourced
by registers GIS.
After the OctalLIU
TM has requested an interrupt by activating its INT pin, the external micro controller should first
read the register CIS to identify the requesting interrupt source channel. Then it should read the Global Interrupt
Status register GIS to identify the requesting interrupt source register ISR of that channel.
After reading the assigned interrupt status registers ISR(1:4), ISR6 and ISR7, the pointer bit in register GIS is
cleared or updated if another interrupt requires service. After all bits ISR(7:0) of a register GIS are cleared, the
assigned bit in register CIS is cleared. After all bits in register CIS are cleared the INT pin will be deactivated.
If all pending interrupts are acknowledged by reading (GIS is reset), pin INT goes inactive.
Updating of interrupt status registers ISR(1:4), ISR6 and ISR7 and GIS is only prohibited during read access.
Global“
Interrupt Status
Register GIS
(per channel)
IMR1
ISR1
IMR3
ISR3
IMR4
ISR4
OctalLIU_ISR_2
IMR6
ISR6
IMR7
ISR7
GIS4
GIS1
GIS2
GIS3
Status Registers and Masking
(shownfor onechannel)
Channel
Interrupt Status
Register CIS ,
global
channel
...
different Status bits
...
INT
channel
GIS8
GIS7
GIS6
GIS5
... 1to8
...
1to8
PLL
PLLLC
PLLL
GIS2
GIMR
PLLLS not visible
VIS
GCR
VISPLL IPC
ISR1
ISR3
ISR4
ISR6
ISR7
ISR1
ISR3
ISR4
ISR6
ISR7
IMR2
ISR2
...
ISR2
R2
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| PEF22554E | DATACOM, FRAMER, PBGA160 |
| PEF22554HT | DATACOM, FRAMER, PQFP144 |
| PES12-42S-N0024 | |
| PESD3V3V4UK,132 | 25 W, UNIDIRECTIONAL, 4 ELEMENT, SILICON, TVS DIODE |
| PF38F3050L0YUQ3A | SPECIALTY MEMORY CIRCUIT, PBGA88 |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| PEF22508EV1.1-G | 功能描述:網(wǎng)絡(luò)控制器與處理器 IC T/E RoHS:否 制造商:Micrel 產(chǎn)品:Controller Area Network (CAN) 收發(fā)器數(shù)量: 數(shù)據(jù)速率: 電源電流（最大值）:595 mA 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:PBGA-400 封裝:Tray |
| PEF22508EV11G | 制造商:Rochester Electronics LLC 功能描述: 制造商:Infineon Technologies AG 功能描述: |
| PEF22508EV11GXP | 制造商:Lantiq 功能描述:LINE INTERFACE UNITS |
| PEF22508EV11GXT | 制造商:Lantiq 功能描述:LINE INTERFACE UNITS |
| PEF22509EV1.1 | 制造商:Infineon Technologies AG 功能描述:SP000205605_T/E ASIC_TY_PB |
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