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參數(shù)資料
| 型號： | PEF22508E |
| 廠商： | INFINEON TECHNOLOGIES AG |
| 元件分類： | 數(shù)字傳輸電路 |
| 英文描述： | DATACOM, PCM TRANSCEIVER, PBGA256 |
| 封裝： | 17 X 17 MM, 1 MM PITCH, PLASTIC, LBGA-256 |
| 文件頁數(shù)： | 138/193頁 |
| 文件大小： | 10683K |
| 代理商： | PEF22508E |
第1頁第2頁第3頁第4頁第5頁第6頁第7頁第8頁第9頁第10頁第11頁第12頁第13頁第14頁第15頁第16頁第17頁第18頁第19頁第20頁第21頁第22頁第23頁第24頁第25頁第26頁第27頁第28頁第29頁第30頁第31頁第32頁第33頁第34頁第35頁第36頁第37頁第38頁第39頁第40頁第41頁第42頁第43頁第44頁第45頁第46頁第47頁第48頁第49頁第50頁第51頁第52頁第53頁第54頁第55頁第56頁第57頁第58頁第59頁第60頁第61頁第62頁第63頁第64頁第65頁第66頁第67頁第68頁第69頁第70頁第71頁第72頁第73頁第74頁第75頁第76頁第77頁第78頁第79頁第80頁第81頁第82頁第83頁第84頁第85頁第86頁第87頁第88頁第89頁第90頁第91頁第92頁第93頁第94頁第95頁第96頁第97頁第98頁第99頁第100頁第101頁第102頁第103頁第104頁第105頁第106頁第107頁第108頁第109頁第110頁第111頁第112頁第113頁第114頁第115頁第116頁第117頁第118頁第119頁第120頁第121頁第122頁第123頁第124頁第125頁第126頁第127頁第128頁第129頁第130頁第131頁第132頁第133頁第134頁第135頁第136頁第137頁當前第138頁第139頁第140頁第141頁第142頁第143頁第144頁第145頁第146頁第147頁第148頁第149頁第150頁第151頁第152頁第153頁第154頁第155頁第156頁第157頁第158頁第159頁第160頁第161頁第162頁第163頁第164頁第165頁第166頁第167頁第168頁第169頁第170頁第171頁第172頁第173頁第174頁第175頁第176頁第177頁第178頁第179頁第180頁第181頁第182頁第183頁第184頁第185頁第186頁第187頁第188頁第189頁第190頁第191頁第192頁第193頁
Data Sheet
49
Rev. 1.0, 2005-06-02
OctalLIU
TM
PEF 22508 E
Functional Description
Figure 12 and Figure 13 show the read and the write operation respectively. The start of a read or write operation
is marked by the falling edge of the chip select signal CS whereas the end of the operations is marked by the rising
edge of CS. Because of CS the SPI interface has no slave address.
The first bit of the serial data in (SDI) is 1 for a read operation and 0 for a write operation. The first four bits of
the 15-bit address are not valid for the OctalLIU
TM.
In read operation the OctalLIU
TM delivers the 8 bit wide content of the addressed register at the serial data out
(SDO).
In general SPI data are driven with the negative edge of the serial clock (SCLK) and sampled with the positive
edge of SCLK. Figure 50 shows the timing of the SPI interface and Table 57 the appropriate timing parameter
values.
Figure 12
SPI Read Operation
Figure 13
SPI Write Operation
3.5.3
Interrupt Interface
Special events in the OctalLIU
TM are indicated by means of an interrupt output INT, which requests the external
micro controller to read status information from the OctalLIU
TM, or to transfer data from/to the OctalLIUTM. The
electrical characteristics (open drain or push-pull) is programmed defined by the register bits IPC.IC(1:0), see IPC.
The OctalLIU
TM has a single interrupt output pin INT with programmable characteristics (open drain or push-pull,
defined by registers IPC) too.
Since only one INT request output is provided, the cause of an interrupt must be determined by the external micro
controller by reading the OctalLIU
TM’s interrupt status registers (GIS, ISR(1:4), ISR6 and ISR7). The interrupt on
pin INT and the interrupt status bits are reset by reading the interrupt status registers. The interrupt status registers
ISR are of type “clear on read“ (“rsc”).
The structure of the interrupt status registers is shown in Figure 14.
Octal_FALC_SPI_read
CS
SCLK
xx
x
A10
A0
D7
D0
11bit address
8bit data
SDI
dont care
highimpedance
SDO
Octal_FALC_SPI_write
CS
SCLK
xx
x
A10
A0 D7
D0
11 bit address
8bit data
SDI
highimpedance
SDO
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| PEF22554E | DATACOM, FRAMER, PBGA160 |
| PEF22554HT | DATACOM, FRAMER, PQFP144 |
| PES12-42S-N0024 | |
| PESD3V3V4UK,132 | 25 W, UNIDIRECTIONAL, 4 ELEMENT, SILICON, TVS DIODE |
| PF38F3050L0YUQ3A | SPECIALTY MEMORY CIRCUIT, PBGA88 |
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參數(shù)描述 |
|---|---|
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