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參數(shù)資料
| 型號(hào)： | MT90866AG2 |
| 廠商： | ZARLINK SEMICONDUCTOR INC |
| 元件分類： | 路由/交換 |
| 英文描述： | Flexible 4 K x 2.4 K Channel Digital Switch with H.110 Interface and 2.4 K x 2.4 K Local Switch |
| 中文描述： | TELECOM, DIGITAL TIME SWITCH, PBGA344 |
| 封裝： | 27 X 27 MM, LEAD FREE, PLASTIC, MS-034, BGA-344 |
| 文件頁(yè)數(shù)： | 68/86頁(yè) |
| 文件大?。?/td> | 701K |
| 代理商： | MT90866AG2 |
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MT90866
Data Sheet
68
Zarlink Semiconductor Inc.
Characteristics are over recommended operating conditions unless otherwise stated.
Typical figures are at 25
°
C and are for design aid only: not guaranteed and not subject to production testing.
Figure 22 - Backplane Frame Pulse Input and Clock Input Timing Diagram
AC Electrical Characteristics - Timing Parameter Measurement Voltage Levels
Characteristics
Sym.
Level
Units
Conditions
1
2
3
CMOS Threshold
Rise/Fall Threshold Voltage High
Rise/Fall Threshold Voltage Low
V
CT
V
HM
V
LM
0.5V
DD
0.7V
DD
0.3V
DD
V
V
V
AC Electrical Characteristics
- Input Frame Pulse and Input Clock Timing
Characteristic
Sym.
Min.
Typ.
Max.
Units Notes
1
2
FRAME_A_io, FRAME_B_io Input Frame Pulse Width
FRAME_A_io, FRAME_B_io Input Frame Pulse Setup
Time
FRAME_A_io, FRAME_B_io Input Frame Pulse Hold
Time
C8_A_io, C8_B_io Input Clock Period
C8_A_io, C8_B_io Input Clock High Time
C8_A_io, C8_B_io Input Clock Low Time
Phase Correction
C8_A_io, C8_B_io Input Rise/Fall Time
t
CFPIW
t
CFPIS
90
45
122
180
90
ns
ns
3
t
CFPIH
45
90
ns
4
5
6
7
8
t
C8MIP
t
C8MIH
t
C8MIL
φ
t
rC8i
, t
fC8i
122-
φ
58-
φ
58-
φ
0
0
122+
φ
64+
φ
64+
φ
10
5
ns
ns
ns
ns
ns
C
BFPIW
FRAME_A_io,
FRAME_B_io
t
BFPH
C8_A_io,
C8_B_io
t
fC8i
t
C8MIL
t
C8MIH
t
CFPIS
t
rC8i
t
C8MIP
(INPUT)
(INPUT)
Backplane Frame Boundary
相關(guān)PDF資料 |
PDF描述 |
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
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