參數(shù)資料
型號(hào)： MPC850
廠商： Motorola, Inc.
英文描述： 32-Bit Microprocessor(32位微處理器)
中文描述： 32位微處理器（32位微處理器）
文件頁數(shù)： 48/1064頁
文件大小： 5301K
代理商： MPC850
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MPC850 Integrated Communications Microprocessor Users Manual
MOTOROLA
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Branch Instructions..................................................................................................5-16
Condition Register Logical Instructions..................................................................5-16
Trap Instructions......................................................................................................5-17
Move to/from Condition Register Instructions........................................................5-17
Memory Synchronization InstructionsUISA.......................................................5-18
Move from Time Base Instruction...........................................................................5-20
Memory Synchronization InstructionsVEA ........................................................5-20
User-Level Cache Instructions.................................................................................5-22
System Linkage Instructions....................................................................................5-22
Move to/from Machine State Register Instructions.................................................5-22
Move to/from Special-Purpose Register Instructions..............................................5-23
Supervisor-Level Cache Management Instruction...................................................5-23
Translation Lookaside Buffer Management Instructions ........................................5-24
Offset of First Instruction by Exception Type...........................................................6-2
Instruction-Related Exception Detection Order.........................................................6-4
Exception Priority......................................................................................................6-4
Register Settings after a System Reset Interrupt Exception ......................................6-5
Register Settings after a Machine Check Interrupt Exception...................................6-6
Register Settings after an External Interrupt..............................................................6-7
Register Settings after an Alignment Exception........................................................6-8
Register Settings after a Program Exception.............................................................6-9
Register Settings after a Decrementer Exception ....................................................6-10
Register Settings after a System Call Exception......................................................6-11
Register Settings after a Trace Exception................................................................6-11
Register Settings after a Software Emulation Exception.........................................6-12
Register Settings after an Instruction TLB Miss Exception ....................................6-13
Register Settings after a Data TLB Miss Exception................................................6-13
Register Settings after an Instruction TLB Error Exception....................................6-14
Register Settings after a Data TLB Error Exception ...............................................6-14
Register Settings after a Debug Exception ..............................................................6-15
Additional SPRs that Affect MSR Bits....................................................................6-17
Exception Latency ...................................................................................................6-19
Before and After Exceptions....................................................................................6-20
Instruction Cache Control and Status RegisterIC_CST.........................................7-7
Instruction Cache Address RegisterIC_ADR ........................................................7-8
Instruction Cache Data Port RegisterIC_DAT ......................................................7-8
IC_ADR Fields for Cache Read Commands.............................................................7-9
IC_DAT Format when Reading a Tag.......................................................................7-9
Data Cache Control and Status RegisterDC_CST...............................................7-12
Data Cache Address RegisterDC_ADR...............................................................7-14
Data Cache Data Port RegisterDC_DAT.............................................................7-14
DC_ADR Fields for Cache Read Commands..........................................................7-14
DC_DAT Format when Reading a Tag...................................................................7-15
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