參數(shù)資料
型號： MPC850
廠商： Motorola, Inc.
英文描述： 32-Bit Microprocessor(32位微處理器)
中文描述： 32位微處理器（32位微處理器）
文件頁數(shù)： 1058/1064頁
文件大小： 5301K
代理商： MPC850
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Index-18
MPC850 Integrated Communications Microprocessor Users Manual
MOTOROLA
INDEX
SRESET
external, 11-2, 11-4
internal, 11-4
reset configuration, 11-11
reset sequence, 11-4
signal, 12-11
SRESET (soft reset) signal, 12-11
Storage reservation, 13-34
String instructions
instruction timing, 9-8
list of instructions, D-23
STS (special transfer start) signal, 13-4
SWSR (software service register), 10-22
SWT,
see
Software watchdog timer
Synchronization
memory synchronization instructions, D-23
overview, 5-6
Synchronization clock (SYNCCLK) signal, 14-14
SYPCR (system protection control register), 10-8
System clock, 14-9
System configuration
interrupt structure, 10-11
overview, 10-2
System development functions, 36-1
System interface unit (SIU)
bus monitor, 10-20
features summary, 10-2
multiplexing SIU signals, 10-4
overview, 1-8, 10-1
programming the interrupt controller, 10-15
programming the SIU, 10-5
System linkage instructions, D-25
System protection overview, 10-2
System reset interrupt, 4-11
T
TA (transfer acknowledge) signal, 12-6, 13-5, 13-33
TAP,
see
IEEE 1149.1 test access port
TBREFU/TBREFL (timebase reference upper/lower)
registers, 10-24
TBSCR (timebase status and control) registers, 10-25
TBU/TBL (time base upper/lower) registers, 4-4
TBU/TBL (timebase upper/lower) registers, 10-24
TEA (transfer error acknowledge)
signal, 12-6, 13-5, 13-33
IDMA channels, 19-22
TECR (trap enable control register), 36-27
Terminology conventions, lxix, II-v
TESR (transfer error status register), 10-9
Test access port (TAP),
see
IEEE 1149.1 test access
port
TFCR (transmit function code register)
overview, 21-16
serial peripheral interface, 31-12
USB controller, 32-9
Timebase, PowerPC, 10-23
Time-division multiplexing (TDM)
channel configuration, 20-5
channel configurations, 20-5
SI RAM
availability, 20-6
dynamic changes, 20-8
overview, 20-8
partitioning SI RAM, 20-8, 20-11
programming example, 20-13
programming SI RAM, 20-11
TDMa
dynamic frames, 20-10
static frames, 20-8, 20-11
TSA implementation, 20-3
Timer capture registers (TCR), 17-10
Timer counter registers (TCN), 17-10
Timer event registers (TER), 17-11
Timer global configuration register (TGCR), 17-8
Timer mode register (TMR), 17-9
Timer reference registers (TRR), 17-10
Time-slot assigner (TSA)
connecting to the TSA, 20-7
disabling TSA, 20-8
enabling TSA, 20-8
overview, 20-3
programming protocols relative to SCC and
SMC, 20-4
SI RAM
availability, 20-6, 20-8
dynamic changes, 20-8
overview, 20-8
partitioning SI RAM, 20-8, 20-11
programming example, 20-13
programming SI RAM, 20-11
TSA signal, 20-7
Timing
IDMA1 burst timing, single-buffer mode, 19-20
SCC timing, controlling, 21-18
timing examples, 9-1
TLB (translation lookaside buffer)
TLB error exception, 7-18
TLB invalidation, 8-34, D-26
TLB management instructions, D-26
TLB manipulation, 8-32
TLB miss exception, 7-18
TLB operation, MMU, 8-5
TLB reload, 8-32
TM_CMD (RISC timer command) register, 18-15
TODR (transmit-on-demand) register
AppleTalk mode, 24-4
overview, 21-11
TOSEQ (transmit out-of-sequence) register, 22-9
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MPC850CZQ50BUR2 功能描述:微處理器 - MPU POWERPC MPU W/CPM RoHS:否 制造商:Atmel 處理器系列:SAMA5D31 核心:ARM Cortex A5 數(shù)據(jù)總線寬度:32 bit 最大時鐘頻率:536 MHz 程序存儲器大小:32 KB 數(shù)據(jù) RAM 大小:128 KB 接口類型:CAN, Ethernet, LIN, SPI,TWI, UART, USB 工作電源電壓:1.8 V to 3.3 V 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:FBGA-324
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