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參數資料
| 型號： | ISP1582BS |
| 廠商： | NXP SEMICONDUCTORS |
| 元件分類： | 總線控制器 |
| 英文描述： | Hi-Speed Universal Serial Bus peripheral controller |
| 中文描述： | UNIVERSAL SERIAL BUS CONTROLLER, PQCC56 |
| 封裝： | 8 X 8 MM, 0.85 MM PITCH, PLASTIC, MO-220, SOT-684-1, HVQFN-56 |
| 文件頁數： | 41/66頁 |
| 文件大小： | 325K |
| 代理商： | ISP1582BS |
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Philips Semiconductors
ISP1582
Hi-Speed USB peripheral controller
Preliminary data
Rev. 03 — 25 August 2004
41 of 66
9397 750 13699
Koninklijke Philips Electronics N.V. 2004. All rights reserved.
9.4.3
DMA Configuration register (address: 38h)
This register defines the DMA configuration for GDMA mode. The DMA Configuration
register consists of 2 bytes. The bit allocation is given in
Table 52
.
Bit
Symbol
Reset
Bus reset
Access
Bit
Symbol
Reset
Bus reset
Access
Bit
Symbol
Reset
Bus reset
Access
23
22
21
20
19
18
17
16
DMACR3 = DMACR[23:16]
0
0
R/W
12
DMACR2 = DMACR[15:8]
0
0
R/W
4
DMACR1 = DMACR[7:0]
0
0
R/W
0
0
0
0
0
0
0
0
0
0
0
0
0
0
R/W
15
R/W
14
R/W
13
R/W
11
R/W
10
R/W
9
R/W
8
0
0
0
0
0
0
0
0
0
0
0
0
0
0
R/W
7
R/W
6
R/W
5
R/W
3
R/W
2
R/W
1
R/W
0
0
0
0
0
0
0
0
0
0
0
0
0
0
0
R/W
R/W
R/W
R/W
R/W
R/W
R/W
Table 51:
Bit
31 to 24
23 to 16
15 to 8
7 to 0
DMA Transfer Counter register: bit description
Symbol
DMACR4, DMACR[31:24]
DMACR3, DMACR[23:16]
DMACR2, DMACR[15:8]
DMACR1, DMACR[7:0]
Description
DMA transfer counter byte 4 (MSB)
DMA transfer counter byte 3
DMA transfer counter byte 2
DMA transfer counter byte 1 (LSB)
Table 52:
Bit
Symbol
Reset
Bus Reset
Access
Bit
Symbol
DMA Configuration register: bit allocation
15
14
13
12
11
10
9
8
reserved
0
0
0
0
0
0
0
0
0
0
0
0
0
0
0
0
R/W
R/W
R/W
5
reserved
R/W
4
R/W
3
R/W
2
R/W
1
R/W
0
WIDTH
7
6
DIS_
XFER_CNT
0
0
R/W
MODE[1:0]
reserved
Reset
Bus Reset
Access
0
0
0
0
0
0
0
0
0
0
0
0
1
1
R/W
R/W
R/W
R/W
R/W
R/W
R/W
相關PDF資料 |
PDF描述 |
|---|---|
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| ISP1583BS | Hi-Speed Universal Serial Bus peripheral controller |
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參數描述 |
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