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參數(shù)資料
| 型號： | DSP56321 |
| 廠商： | 飛思卡爾半導(dǎo)體(中國)有限公司 |
| 元件分類： | 數(shù)字信號處理 |
| 英文描述： | 24-Bit Digital Signal Processor |
| 中文描述： | 24位數(shù)字信號處理器 |
| 文件頁數(shù)： | 76/84頁 |
| 文件大?。?/td> | 898K |
| 代理商： | DSP56321 |
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DSP56321 Technical Data, Rev. 11
A-12
Freescale Semiconductor
Power Consumption Benchmark
M_DPR0 EQU 17
M_DPR1 EQU 18
M_DTM EQU $380000
M_DTM0 EQU 19
M_DTM1 EQU 20
M_DTM2 EQU 21
M_DIE EQU 22
M_DE EQU 23
; DMA Channel Priority Level (low)
; DMA Channel Priority Level (high)
; DMA Transfer Mode Mask (DTM2-DTM0)
; DMA Transfer Mode 0
; DMA Transfer Mode 1
; DMA Transfer Mode 2
; DMA Interrupt Enable bit
; DMA Channel Enable bit
; DMA Status Register
M_DTD EQU $3F
M_DTD0 EQU 0
M_DTD1 EQU 1
M_DTD2 EQU 2
M_DTD3 EQU 3
M_DTD4 EQU 4
M_DTD5 EQU 5
M_DACT EQU 8
M_DCH EQU $E00
M_DCH0 EQU 9
M_DCH1 EQU 10
M_DCH2 EQU 11
; Channel Transfer Done Status MASK (DTD0-DTD5)
; DMA Channel Transfer Done Status 0
; DMA Channel Transfer Done Status 1
; DMA Channel Transfer Done Status 2
; DMA Channel Transfer Done Status 3
; DMA Channel Transfer Done Status 4
; DMA Channel Transfer Done Status 5
; DMA Active State
; DMA Active Channel Mask (DCH0-DCH2)
; DMA Active Channel 0
; DMA Active Channel 1
; DMA Active Channel 2
;------------------------------------------------------------------------
;
; EQUATES for Enhanced Filter Co-Processor (EFCOP)
;
;------------------------------------------------------------------------
M_FDIR EQU $FFFFB0 ; EFCOP Data Input Register
M_FDOR EQU $FFFFB1 ; EFCOP Data Output Register
M_FKIR EQU $FFFFB2 ; EFCOP K-Constant Register
M_FCNT EQU $FFFFB3 ; EFCOP Filter Counter
M_FCSR EQU $FFFFB4 ; EFCOP Control Status Register
M_FACR EQU $FFFFB5 ; EFCOP ALU Control Register
M_FDBA EQU $FFFFB6 ; EFCOP Data Base Address
M_FCBA EQU $FFFFB7 ; EFCOP Coefficient Base Address
M_FDCH EQU $FFFFB8 ; EFCOP Decimation/Channel Register
;-----------------------------------------------------------------------
;
; EQUATES for Phase Locked Loop (PLL)
;
;----------------------------------------------------------------------
; Register Addresses Of PLL
M_DMFR EQU $FFFFD0
M_DPSC EQU $FFFFD0
M_PCTL EQU $FFFFD1 ; PLL Control Register
; PLL Control Register
M_MFI EQU $F ; Multiplication Factor Intager Bits Mask (MFI0-MFI3)
M_MFN EQU $7F0 ; Multiplication Factor Bits Mask (MFN0-MFN6)
M_MFD EQU $3F800
; Multiplication Factor Bits Mask (MFD0-MFD6)
M_PDF EQU $3C0000 ; PreDivider Factor Bits Mask (PD0-PD3)
M_CPLM EQU
22
;
M_MFO
EQU
23
;
M_CDF EQU $70 ; Division Factor Bits Mask (DF0-DF2)
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PDF描述 |
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