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參數(shù)資料
| 型號(hào)： | 935268625551 |
| 廠商： | NXP SEMICONDUCTORS |
| 元件分類： | 總線控制器 |
| 英文描述： | UNIVERSAL SERIAL BUS CONTROLLER, PQFP64 |
| 封裝： | 10 X 10 MM, 1.40 MM HEIGHT, PLASTIC, MS-026, SOT-314-2, LQFP-64 |
| 文件頁(yè)數(shù)： | 55/82頁(yè) |
| 文件大?。?/td> | 1965K |
| 代理商： | 935268625551 |
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Philips Semiconductors
ISP1581
Hi-Speed USB interface device
Product data
Rev. 05 — 26 February 2003
59 of 78
9397 750 10766
Koninklijke Philips Electronics N.V. 2003. All rights reserved.
Fig 17. ISP1581 register access timing: multiplexed address/data bus (BUS_CONF = 0, MODE1 = 1, MODE0 = 1).
address
data
(write) AD[7:0]
(read) AD[7:0]
tWHSH
tRHSH
tRHDZ
tRLDV
tDVWH
tWHDZ
tA0WL
004aaa011
Tcy(RW)
RD
(I1)
WR
(I2)
CS
RD
A0
tWHRH
tWLWH
tWHWH
tAVWH
tRLRH
WR
Table 77:
ISP1581 register access timing parameters: multiplexed address/data bus (MODE1 = 1)
VCC = 4.0 to 5.5 V; VGND =0V; Tamb = 40 to +85 °C.
Symbol
Parameter
Min
Max
Unit
Reading
tRLDV
RD LOW to data valid delay
-
26
ns
tRHDZ
RD HIGH to data outputs three-state delay
0
15
ns
tRHSH
RD HIGH to CS HIGH delay
0
-
ns
tRLRH
RD LOW pulse width
>tRLDV
-ns
tWHRH
WR/DS HIGH to RD HIGH delay
40
-
ns
Writing
tA0WL
A0 set-up time before WR/DS LOW
0
-
ns
tAVWH
address set-up time before WR/DS HIGH
5
-
ns
tDVWH
data set-up time before WR/DS HIGH
5
-
ns
tWHDZ
data hold time after WR/DS HIGH
5
-
ns
tWHSH
WR/DS HIGH to CS HIGH delay
0
-
ns
tWLWH
WR/DS LOW pulse width
15
-
ns
tWHWH
WR/DS HIGH (address) to WR/DS HIGH (data) delay
40
-
ns
General
Tcy(RW)
read/write cycle time
80
-
ns
tI2HI1X
R/W hold time after DS HIGH
5
-
ns
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PDF描述 |
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