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參數(shù)資料
| 型號(hào)： | 935268625551 |
| 廠商： | NXP SEMICONDUCTORS |
| 元件分類： | 總線控制器 |
| 英文描述： | UNIVERSAL SERIAL BUS CONTROLLER, PQFP64 |
| 封裝： | 10 X 10 MM, 1.40 MM HEIGHT, PLASTIC, MS-026, SOT-314-2, LQFP-64 |
| 文件頁數(shù)： | 52/82頁 |
| 文件大?。?/td> | 1965K |
| 代理商： | 935268625551 |
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Philips Semiconductors
ISP1581
Hi-Speed USB interface device
Product data
Rev. 05 — 26 February 2003
56 of 78
9397 750 10766
Koninklijke Philips Electronics N.V. 2003. All rights reserved.
Fig 14. Set-up and hold time.
ALE
004aaa277
WR
CS
RD
t
LLSH
t
SLWL
t
SLRL
t
WHSH
t
RHSH
Table 76:
ISP1581 register access timing parameters: multiplexed address/data bus (MODE1 = 0)
VCC = 4.0 to 5.5 V; VGND =0V; Tamb = 40 to +85 °C.
Symbol
Parameter
Min
Max
Unit
Reading
tRLRH
RD LOW pulse width
>tRLDV
-ns
tRLDV
RD LOW to data valid delay
-
25
ns
tRHDZ
RD HIGH to data outputs three-state delay
0
15
ns
tRHSH
RD HIGH to CS HIGH delay
0
-
ns
tLLRL
ALE LOW set-up time before RD LOW
0
-
ns
Writing
tWLWH
WR/DS LOW pulse width
15
-
ns
tDVWH
data set-up time before WR HIGH
5
-
ns
tLLWL
ALE LOW to WR/DS LOW delay
0
-
ns
tWHDZ
data hold time after WR/DS HIGH
5
-
ns
tWHSH
WR/DS HIGH to CS HIGH delay
0
-
ns
General
Tcy(RW)
read/write cycle time
80
-
ns
tAVLL
address set-up time before ALE LOW
5
-
ns
tI1VLL
R/W set-up time before ALE LOW
5
-
ns
tLLI2L
ALE LOW to DS LOW delay
5
-
ns
tI2HI1X
R/W hold time after DS HIGH
5
-
ns
tLLSH
ALE LOW to CS HIGH
0
-
ns
tSLWL
CS LOW to WR LOW
0
-
ns
tSLRL
CS LOW to RD LOW
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| 080207R0 | TELEFON-AKKU |
| 080216R0 | TELEFON-AKKU |
| 080219R0 | TELEFON-AKKU |
| 080251R0 | TELEFON-AKKU |
| 935268664112 | 133 MHz, PROC SPECIFIC CLOCK GENERATOR, PDSO56 |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| 935268721125 | 制造商:NXP Semiconductors 功能描述:Buffer/Line Driver 1-CH Non-Inverting 3-ST CMOS 5-Pin TSSOP T/R |
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| 935269987557 | 制造商:NXP Semiconductors 功能描述:SUB ONLY TDA9587-1US1-V1.8 SUBBED TO 935269987557 |
| 935270713557 | 制造商:NXP Semiconductors 功能描述:SUB ONLY IC CHP |
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