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參數(shù)資料
| 型號： | 68HC11 |
| 廠商： | Motorola, Inc. |
| 英文描述： | Technical Data |
| 中文描述： | 技術數(shù)據(jù) |
| 文件頁數(shù)： | 215/336頁 |
| 文件大?。?/td> | 3387K |
| 代理商： | 68HC11 |
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Analog-to-Digital (A/D) Converter
Conversion Process
MC68HC11E Family
—
Rev. 4
Technical Data
MOTOROLA
Analog-to-Digital (A/D) Converter
215
DLY
—
Enable Oscillator Startup Delay Bit
0 = The oscillator startup delay coming out of stop is bypassed and
the MCU resumes processing within about four bus cycles.
1 = A delay of approximately 4000 E-clock cycles is imposed as the
MCU is started up from the stop power-saving mode. This
delay allows the crystal oscillator to stabilize.
CME
—
Clock Monitor Enable Bit
Refer to
Section 5. Resets and Interrupts
.
Bit 2
—
Not implemented
Always reads 0
CR[1:0]
—
COP Timer Rate Select Bits
Refer to
Section 5. Resets and Interrupts
and
Section 9. Timing
System
.
10.5 Conversion Process
The A/D conversion sequence begins one E-clock cycle after a write to
the A/D control/status register, ADCTL. The bits in ADCTL select the
channel and the mode of conversion.
An input voltage equal to V
RL
converts to $00 and an input voltage equal
to V
RH
converts to $FF (full scale), with no overflow indication. For
ratiometric conversions of this type, the source of each analog input
should use V
RH
as the supply voltage and be referenced to V
RL
.
相關PDF資料 |
PDF描述 |
|---|---|
| 68HC12 | Advance Information |
| 68HC12DG128 | Advance Information |
| 68HC912DG128PV8 | Advance Information |
| 68HC912DG128VPV8 | Advance Information |
| 68HC912DG128 | Advance Information |
相關代理商/技術參數(shù) |
參數(shù)描述 |
|---|---|
| 68HC11A1FN | 制造商: 功能描述: |
| 68HC11D0P | 制造商: 功能描述: 制造商:undefined 功能描述: |
| 68HC11E1CFN2 | 制造商:Motorola Inc 功能描述: |
| 68HC11E1FN | 制造商:undefined 功能描述: |
| 68HC11F1FN | 制造商: 功能描述: 制造商:undefined 功能描述: |
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