參數(shù)資料
型號： TMS320VC203
廠商： Texas Instruments, Inc.
元件分類： 數(shù)字信號處理
英文描述： Digital Signal Processors(50ns指令周期， 空閑狀態(tài)CPU全關(guān)斷，先進的外圍，多種PLL可選)
中文描述： 數(shù)字信號處理器（50ns的指令周期，空閑狀態(tài)CPU的全關(guān)斷，先進的外圍，多種鎖相環(huán)可選）
文件頁數(shù)： 49/67頁
文件大?。?/td> 1452K
代理商： TMS320VC203
TMS320C203, TMS320C209, TMS320VC203
DIGITAL SIGNAL PROCESSOR
SPRS025 – JUNE 1995
49
POST OFFICE BOX 1443
HOUSTON, TEXAS 77251–1443
timing with the PLL circuit enabled x2 mode
NAME
PARAMETER
TEST CONDITIONS
TC = 0
°
C to 85
°
C, 3 V
TC = 0
°
C to 85
°
C, 5 V
MIN
5
5
MAX
14.25
UNIT
MHz
MHz
fx
Input clock frequency
20
switching characteristics over recommended operating conditions @ 5 V [H = 0.5t
c(CO)
]
’320C2XX-40
MIN
tc(CO)
Cycle time, CLKOUT1
50
Delay time, CLKIN high to CLKOUT1
high/low
PARAMETER
’320C2XX-57
MIN
35
’320C2XX-80
MIN
25
UNIT
TYP
MAX
100
TYP
MAX
TYP
MAX
75
55
ns
td(CIH-CO)
3
8
18
3
8
18
1
8
16
ns
tf(CO)
tr(CO)
tw(COL)
tw(COH)
Fall time, CLKOUT1
5
5
4
ns
Rise time, CLKOUT1
5
5
4
ns
Pulse duration, CLKOUT1 low
H – 2
H
H + 2
H – 2
H
H + 2
H – 2
H
H + 2
ns
Pulse duration, CLKOUT1 high
H – 2
H
H + 2
H – 2
H
H + 2
H – 2
H
H + 2
ns
tp
Transition time, PLL synchronized after
CLKIN supplied
1000
1000
1000
cycles
timing requirements over recommended operating conditions @ 5 V
’320C2XX-40
MIN
50
’320C2XX-57
MIN
35
’320C2XX-80
MIN
25
UNIT
MAX
100
MAX
MAX
tc(CI)
Cycle time, CLKIN multiply by one
75
75
ns
Cycle time, CLKIN multiply by two
100
200
70
200
50
150
ns
tf(CI)
tr(CI)
tw(CIL)
tw(CIH)
Fall time, CLKIN
4
4
4
ns
Rise time, CLKIN
4
4
4
ns
Pulse duration, CLKIN low
16
95
14
95
11
95
ns
Pulse duration, CLKIN high
16
95
14
95
11
95
ns
switching characteristics over recommended operating conditions @ 3 V
’320C2XX-40
MIN
TYP
’320C2XX-57
MIN
TYP
UNIT
MAX
MAX
tc(CO)
td(CIH-CO)
tf(CO)
tr(CO)
tw(COL)
tw(COH)
tp
Cycle time, CLKOUT1
50
2tc(CI)
75
35
2tc(CI)
75
ns
Delay time, CLKIN high to CLKOUT1 high/low
3
8
18
3
8
118
ns
Fall time, CLKOUT1
5
5
ns
Rise time, CLKOUT1
5
5
ns
Pulse duration, CLKOUT low
H – 2
H
H + 2
H – 2
H
H + 2
ns
Pulse duration, CLKOUT high
H – 2
H
H + 2
H – 2
H
H + 2
ns
Transition time, PLL synchronized after CLKIN supplied
1000
1000
cycles
A
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