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參數(shù)資料
| 型號： | TMS320VC203 |
| 廠商： | Texas Instruments, Inc. |
| 元件分類： | 數(shù)字信號處理 |
| 英文描述： | Digital Signal Processors(50ns指令周期， 空閑狀態(tài)CPU全關(guān)斷，先進的外圍，多種PLL可選) |
| 中文描述： | 數(shù)字信號處理器（50ns的指令周期，空閑狀態(tài)CPU的全關(guān)斷，先進的外圍，多種鎖相環(huán)可選） |
| 文件頁數(shù)： | 46/67頁 |
| 文件大?。?/td> | 1452K |
| 代理商： | TMS320VC203 |
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TMS320C203, TMS320C209, TMS320VC203
DIGITAL SIGNAL PROCESSOR
SPRS025 – JUNE 1995
46
POST OFFICE BOX 1443
HOUSTON, TEXAS 77251–1443
CLOCK CHARACTERISTICS AND TIMING
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PARAMETER
CLKMOD
TMS320C203 clock options
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ááááááááááááááááááááááááááááááááá
PLL multiply by four
1
PLL multiply by two
1
0
1
internal divide-by-two clock option with external crystal
The internal oscillator is enabled by connecting a crystal across X1 and X2/CLKIN. The frequency of CLKOUT1
is one-half the crystal’s oscillating frequency. The crystal should be in either fundamental or overtone operation
and parallel resonant, with an effective series resistance of 30 ohms and a power dissipation of 1 mW; it should
be specified at a load capacitance of 20 pF. Note that overtone crystals require an additional tuned-LC circuit.
Figure 11 shows an external crystal (fundamental frequency) connected to the on-chip oscillator.
TMS320C2xx timing at V
pp
= 5 V with the PLL circuit disabled, divide-by-two mode
TEST CONDITIONS
MIN
NOM
MAX
80
57.14
40.96
UNIT
fx
Input clock frequency
TC = 0
C to 85
C
°
°
0
MHz
C1, C2 Load capacitance
10
pF
This device utilizes a fully static design and, therefore, can operate with input clock cycle time (tc(CI)) approaching infinity. The device is
characterized at frequencies approaching 0 Hz, but is tested at fclk = 6.7 MHz to meet device test time requirements.
X1
X2/CLKIN
C1
C2
Crystal
Figure 11. Internal Clock Option
A
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