參數(shù)資料
型號(hào)： TMS320VC203
廠商： Texas Instruments, Inc.
元件分類： 數(shù)字信號(hào)處理
英文描述： Digital Signal Processors(50ns指令周期， 空閑狀態(tài)CPU全關(guān)斷，先進(jìn)的外圍，多種PLL可選)
中文描述： 數(shù)字信號(hào)處理器（50ns的指令周期，空閑狀態(tài)CPU的全關(guān)斷，先進(jìn)的外圍，多種鎖相環(huán)可選）
文件頁(yè)數(shù)： 37/67頁(yè)
文件大?。?/td> 1452K
代理商： TMS320VC203
TMS320C203, TMS320C209, TMS320VC203
DIGITAL SIGNAL PROCESSORS
SPRS025 – JUNE 1995
37
POST OFFICE BOX 1443
HOUSTON, TEXAS 77251–1443
Table 16. TMS320C2xx Instruction Set Summary (Continued)
C2xx
DESCRIPTION
WORDS/
CYCLES
OPCODE
MNEMONIC
MSB
LSB
SACL
Store low accumulator with shift
1/1
1001
0SHF
IADD
RESS
SAR
Store auxiliary register
1/1
1000
OARx
IADD
RESS
SBRK
Subtract from auxiliary register short immediate
1/1
0111
1100
8BIT
CNST
SETC
Set carry bit
1/1
1011
1110
0100
1111
SFL
Shift accumulator left
1/1
1011
1110
0000
1001
SFR
Shift accumulator right
1/1
1011
1110
0000
1010
SETC
Set overflow mode
1/1
1011
1110
0100
0011
SPAC
Subtract P register from accumulator
1/1
1011
1110
0000
0101
SPH
Store high-P register
1/1
1000
1101
IADD
RESS
SPL
Store low-P register
1/1
1000
1100
IADD
RESS
SPM
Set P register output shift mode
1/1
1011
1111
IADD
RESS
SQRA
Square and accumulate
1/1
0101
0010
IADD
RESS
SQRS
Square and subtract previous product from accumulator
1/1
0101
0011
IADD
RESS
SST
Store status register ST0
1/1
1000
1110
IADD
RESS
SST
Store status register ST1
1/1
1000
1111
IADD
RESS
SPLK
Store long immediate to data memory
2/2
1010
1110
16-Bit Constant
IADD
RESS
SSXM
Set sign-extension mode
1/1
1011
1110
0100
0111
SETC
Set test/control flag
1/1
1011
1110
0100
1011
SUB
Subtract from accumulator long immediate with shift
2/2
1011
1111
16-Bit Constant
1010
SHFT
Subtract from accumulator with shift
1/1
0011
SHFT
IADD
RESS
Subtract from high accumulator
1/1
0110
0101
IADD
RESS
Subtract from accumulator short immediate
1/1
1011
1010
8BIT
CNST
SUBB
Subtract from accumulator with borrow
1/1
0110
0100
IADD
RESS
SUBC
Conditional subtract
1/1
0000
1010
IADD
RESS
SUBS
Subtract from low accumulator with sign extension suppressed
1/1
0110
0110
IADD
RESS
SUBT
Subtract from accumulator with shift specified by TREG
1/1
0110
0111
IADD
RESS
SETC
Set external flag
1/1
1010
0110
IADD
RESS
TBLR
Table read
1/3
1010
0111
IADD
RESS
TBLW
Table write
1/3
1011
1110
0101
0001
TRAP
Software interrupt
1/4
1011
1110
0101
0001
XOR
Exclusive-OR with accumulator
1/1
0110
1100
IADD
RESS
Exclusive-OR immediate with accumulator with shift
2/2
1011
1111
16-Bit Constant
1101
SHFT
Exclusive-OR immediate with accumulator with shift of 16
2/2
1011
1110
16-Bit Constant
1000
0011
LACL
Zero accumulator
1/1
1011
1001
0000
0000
Zero low accumulator and load high accumulator
1/1
0110
1010
IADD
RESS
Zero low accumulator and load low accumulator with no sign extension
1/1
0110
1001
IADD
RESS
ZALR
Zero low accumulator and load high accumulator with rounding
1/1
0110
1000
IADD
RESS
A
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