參數(shù)資料
型號(hào): ST72124J2B7
廠商: 意法半導(dǎo)體
英文描述: 8-BIT MCU WITH SINGLE VOLTAGE FLASH MEMORY, ADC, 16-BIT TIMERS, SPI, SCI INTERFACES
中文描述: 8位單電壓閃存,ADC和16位定時(shí)器,SPI和脊髓損傷界面微控制器
文件頁(yè)數(shù): 29/125頁(yè)
文件大?。?/td> 776K
代理商: ST72124J2B7
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ST72334J/N, ST72314J/N, ST72124J
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RESET SEQUENCE MANAGER
(Cont’d)
Internal Watchdog RESET
The RESET sequence generated by a internal
Watchdog counter overflow is shown in Figure 18.
Starting fromthe Watchdog counterunderflow, the
device RESET pin acts as an output that is pulled
low during at least t
DELAYmin
.
Figure 18. Watchdog RESET Sequence
RESET
RUN
DELAY
INTERNAL RESET
4096 CLOCK CYCLES
FETCH
VECTOR
RUN
RESET PIN
EXTERNAL RESET SOURCE
V
DD
V
LVDf
V
DDnominal
WATCHDOG RESET
WATCHDOG UNDERFLOW
t
DELAYmin
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PDF描述
ST72C124J2B7 CAP 120PF 25V CERAMIC X7R 0402
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ST72124J2T7 CAP 180PF 25V CERAMIC X7R 0402
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