參數(shù)資料
型號(hào)： SIS5595
廠商： Electronic Theatre Controls, Inc.
英文描述： Pentium PCI System I/O Chipset
中文描述： 奔騰的PCI系統(tǒng)I / O芯片
文件頁(yè)數(shù)： 72/216頁(yè)
文件大?。?/td> 2208K
代理商： SIS5595
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SiS5595 PCI System I/O Chipset
Preliminary V2.0 Nov. 2, 1998 66 Silicon Integrated Systems Corporation
89
DEVSEL#
I/O
Device Select:
SiS5595 will do positive decoding with medium
timing to:
- SiS5595 PCI configuration registers access
- Built-in legacy ISA bus embedded controller
registers access
- BIOS ROM memory access
- Interrupt acknowledge cycle
In addition, SiS5595 will do subtractive decoding to:
-
I/O address range 00000000h-0000FFFFh.(Low
64 Kbytes)
-
Memory address range 00000000h-00FFFFFFh
(Low 16 Mbytes).
PCI STOP#: Comply with PCI specification 2.1
PCI Bus Hold Request:
PHOLD# is asserted to inform the PCI system arbiter
located at north-bridge chipset that SiS5595 is
intending to become PCI bus master. SiS5595
asserts PHOLD# on behalf of three local devices
including ISA/DMA master, Distributed DMA master
and USB master.
PCI Bus Hold Acknowledge:
The PCI system arbiter responds to the assertion of
PHOLD# by driving PHLDA# low, indicating SiS5595
can start its PCI master cycles.
PCI interrupt A,B,C,D:
The PCI interrupts will be connected to the inputs of
the internal Interrupt controller through the rerouting
logic associated with each PCI interrupt.
PCI Bus Reset:
PCIRST# will be asserted during the period when
PWRGD is low, and will be kept on asserting until
about 1 ms after PWRGD goes high.
PC/PCI DMA Request 0:
This signal is used by PCI
agent to request DMA services.
PC/PCI DMA Grant 0:
This signal is used by 5595 to
indicate which DMA channel is granted.
Non-Maskable Interrupt:
A rising edge on NMI will trigger a non-maskable
interrupt to CPU. This signal requires an external
pull-up resistor tied to 3.3V.
84
113
STOP#
PHOLD#
I/O
O
125
PHLDA#
I
56, 57, 59,
60
INT[A:D]#
I
126
PCIRST#
OD
151
PDMAREQ0#
I
130
PDMAGNT0#
O
47
NMI
OD
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