參數(shù)資料
型號： SIS5595
廠商： Electronic Theatre Controls, Inc.
英文描述： Pentium PCI System I/O Chipset
中文描述： 奔騰的PCI系統(tǒng)I / O芯片
文件頁數(shù)： 126/216頁
文件大?。?/td> 2208K
代理商： SIS5595
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SiS5595 PCI System I/O Chipset
Preliminary V2.0 Nov. 2, 1998 120 Silicon Integrated Systems Corporation
6
R/W
Wake-up Enable—Floppy port Access
When set, any I/O access to the ports 3F0-3F7h, 370-377h, or an
active DRQ2 will cause the wake-up status bit to be set.
Wake-up Enable—Primary IDE Channel Device 1
When set, any I/O access to the primary IDE channel device 1
associated ports will cause the wake-up status bit to be set.
Wake-up Enable—Secondary IDE Channel Device 1
When set, any I/O access to the secondary IDE channel device 1
associated ports will cause the wake-up status bit to be set.
Reserved.
These bits must be programmed to 0.
5
R/W
4
R/W
3:0
R/W
Register 58h ~ 5Bh
Reserved
Default Value : 00000000h
Access :
BIT
31:0
Read/Write
ACCESS
R/W
DESCRIPTION
Reserved.
These bits must be programmed to 0.
Register 5Ch ~ 5Dh
Programmable 10-bit I/O Port Trap Address
Default Value : 0000h
Access :
BIT
15:10
Read/Write
ACCESS
R/W
DESCRIPTION
Programmable 10-bit I/O Port Trap Address Mask Bits
These bits correspond to the mask bits for A[5:0] of the 10-bit I/O
Port Trap Address. A 1 in the bit position indicates the
corresponding address bit should be masked (ignored) when
doing address comparison.
Programmable 10-bit I/O Port Trap Address Base
These bits correspond to A[9:0] of the base address. Note that a
matched address must have its A[15:10] set to all 0s.
9:0
R/W
Register 5Eh ~ 5Fh
Programmable 16-bit I/O Port Trap Address
Default Value : 0000h
Access :
BIT
15:0
Read/Write
ACCESS
R/W
DESCRIPTION
Correspond to A[15:0] for the Programmable 16-bit I/O port
Note that there are five address mask bits defined in Reg.
4Ch~4Dh, bit [12:8] can be used to mask A[4:0] defined in this
register.
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