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參數(shù)資料
| 型號： | S5933Q/7C |
| 廠商： | APPLIEDMICRO INC |
| 元件分類： | 總線控制器 |
| 英文描述： | PCI BUS CONTROLLER, PQFP160 |
| 封裝： | PLASTIC, QFP-160 |
| 文件頁數(shù)： | 22/327頁 |
| 文件大?。?/td> | 1976K |
| 代理商： | S5933Q/7C |
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Applied Micro Circuits Corporation
6195 Lusk Blvd., San Diego, CA 92121 (619) 450-9333
8-5
PCI CONTROLLER
S5933
DEVICE SPECIFICATION
Read accesses from the S5933 operation registers
(S5933 as a target) are shown in Figure 8-2. The
S5933 conditionally asserts STOP# in clock period 3
if the initiator keeps FRAME# asserted during clock
period 2 with IRDY# asserted (indicating a burst is
being attempted). Wait states may be added by the
initiator by not asserting the signal IRDY# during
clock 3 and beyond. If FRAME# remains asserted,
but IRDY# is not asserted, the initiator is just adding
wait states, not necessarily attempting a burst.
There is only one condition where accesses to S5933
operation registers do not return TRDY# but do as-
sert STOP#. This is called a target-initiated termina-
tion or target disconnect (described in more detail in
Section 8.1.5) and occurs when a read attempt is
made to an empty S5933 FIFO. The assertion of
STOP# without the assertion of TRDY# indicates that
the initiator should retry the operation later. This is
discussed further in Section 8.1.5.2.
When burst read transfers are attempted to the
S5933 operation registers, STOP# is asserted during
the first data transfer to indicate to the initiator that no
further transfers (data phases) are possible. This is a
target-initiated termination where the target discon-
nects after the first data transfer. Figure 8-3 shows
the signal relationships during a burst read attempt to
the S5933 operation registers.
Figure 8-2. Single Data Phase PCI Bus Read of S5933 Registers (S5933 as Target)
FRAME #
AD [31:0]
C/BE [3:0]#
IRDY#
TRDY#
DEVSEL#
STOP#
ADDRESS
DATA
BYTE ENABLES
BUS COMMAND
1
2
3
45
(I)
(T)
(I)
(T)
(I) = DRIVEN BY INITIATOR
(T) = DRIVEN BY TARGET
Figure 8-3. Burst PCI Bus Read Attempt to S5933 Registers (S5933 as Target)
PCI CLOCK
FRAME #
AD [31:0]
C/BE [3:0]#
IRDY#
TRDY#
DEVSEL#
STOP#
ADDRESS
DATA
BYTE ENABLES (1)
1
2
3
45
(I)
(T)
(I)
BE (2)
BUS COMMAND
(I) = DRIVEN BY INITIATOR
(T) = DRIVEN BY TARGET
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| S5933QE | PCI BUS CONTROLLER, PQFP160 |
| S6A0032 | 16 X 80 DOTS DOT MAT LCD DRVR AND DSPL CTLR, UUC138 |
| S6A0069 | 16 X 40 DOTS DOT MAT LCD DRVR AND DSPL CTLR, UUC80 |
| S6A0078 | 34 X 120 DOTS DOT MAT LCD DRVR AND DSPL CTLR, UUC183 |
| S80296SA40 | 16-BIT, 40 MHz, MICROCONTROLLER, PQFP100 |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| S5933QC | 制造商:AMC 功能描述:IC |
| S5935 | 制造商:AMCC 制造商全稱:Applied Micro Circuits Corporation 功能描述:PCI Product |
| S5935_07 | 制造商:AMCC 制造商全稱:Applied Micro Circuits Corporation 功能描述:PCI Product |
| S59355QRC | 制造商:AppliedMicro 功能描述: |
| S5935QF | 制造商:AMCC 制造商全稱:Applied Micro Circuits Corporation 功能描述:PCI Product |
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