參數(shù)資料
型號： S1D13706F00A
元件分類： 顯示控制器
英文描述： 320 X 240 PIXELS CRT OR FLAT PNL GRPH DSPL CTLR, PQFP100
封裝： TQFP-100
文件頁數(shù)： 88/171頁
文件大小： 4940K
代理商： S1D13706F00A
APPENDIX
Appendix 3. Control registers
7751 Group User’s Manual
20–27
Pulse period/pulse width measurement mode
Measurement mode select bits
1
Operating mode select bits
Bit name
Functions
b7
b6
b5
b4
b3
b2
b1
b0
Timer Bi mode register (i = 0 to 2) (Addresses 5B16 to 5D16)
1 0 : Pulse period/Pulse width
measurement mode
7
0 0 : f2 / f4
0 1 : f16 / f32
1 0 : f64 / f128
1 1 : f512 / f1024
b7 b6
Count source select bits
b1 b0
b3 b2
Nothing is assigned.
0
1
0 0 : Pulse period measurement
(Interval between falling edges
of measurement pulse)
0 1 : Pulse period measurement
(Interval between rising edges
of measurement pulse)
1 0 : Pulse width measurement
(Interval from a falling edge to a rising
edge, and from a rising edge to a
falling edge of measurement pulse)
1 1 : Not selected
Bit
At reset
Undefined
0
RW
4
0
2
3
6
RW
–
RW
b7
b0
b7
b0
(b15)
(b8)
Timer B0 register (Addresses 5116, 5016)
Timer B1 register (Addresses 5316, 5216)
Timer B2 register (Addresses 5516, 5416)
Functions
Bit
RW
15 to 0 The measurement result of pulse period or
pulse width is read out.
Undefined
RO
5
0
Timer Bi overflow flag
(Note)
0 : No overflow
1 : Overflowed
Undefined
RO
0
Note: The timer Bi overflow flag is cleared to “0” by writing to the timer Bi mode register with the
count start bit = “1”. The timer Bi overflow flag cannot be set to “1” by software.
At reset
相關(guān)PDF資料
PDF描述
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S1D13A05B00B 320 X 320 PIXELS CRT OR FLAT PNL GRPH DSPL CTLR, PBGA121
S1D13A05F00A100 320 X 320 PIXELS CRT OR FLAT PNL GRPH DSPL CTLR, PBGA121
S1R72005F00A300 UNIVERSAL SERIAL BUS CONTROLLER, PQFP64
S1R72105F00A000 SCSI BUS CONTROLLER, PQFP100
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參數(shù)描述
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