參數(shù)資料
型號： S1D13706F00A
元件分類： 顯示控制器
英文描述： 320 X 240 PIXELS CRT OR FLAT PNL GRPH DSPL CTLR, PQFP100
封裝： TQFP-100
文件頁數(shù)： 74/171頁
文件大?。?/td> 4940K
代理商： S1D13706F00A
APPENDIX
Appendix 3. Control registers
7751 Group User’s Manual
20–14
UARTi transmit/receive mode register
UARTi baud rate register (BRGi)
b7
b6
b5
b4
b3
b2
b1
b0
Bit
4
2
1
0
Bit name
At reset
0
RW
Functions
b2 b1 b0
3
7
6
5
RW
0
Serial I/O mode select bits
0 0 0 : Serial I/O disabled
(P8 functions as a programmable
I/O port.)
0 0 1 : Clock synchronous serial I/O
mode
0 1 0 : Not selected
0 1 1 : Not selected
1 0 0 : UART mode
(Transfer data length = 7 bits)
1 0 1 : UART mode
(Transfer data length = 8 bits)
1 1 0 : UART mode
(Transfer data length = 9 bits)
1 1 1 : Not selected
Sleep select bit
(Valid in UART mode) (Note)
Parity enable bit
(Valid in UART mode) (Note)
Odd/Even parity select bit
(Valid in UART mode when
parity enable bit is “1”) (Note)
Stop bit length select bit
(Valid in UART mode) (Note)
Internal/External clock select bit
UART0 transmit/receive mode register (Address 3016)
UART1 transmit/receive mode register (Address 3816)
Note: Bits 4 to 6 are ignored in the clock synchronous serial I/O mode. (They may be either “0”
or “1.”) Additionally, fix bit 7 to “0.”
0 : Odd parity
1 : Even parity
0 : Parity disabled
1 : Parity enabled
0 : Sleep mode cleared (ignored)
1 : Sleep mode selected
0 : Internal clock
1 : External clock
0 : One stop bit
1 : Two stop bits
0
b7
b0
UART0 baud rate register (Address 3116)
UART1 baud rate register (Address 3916)
Functions
Bit
At reset
RW
7 to 0
Can be set to “0016” to “FF16.”
Assuming that the set value = n, BRGi
divides the count source frequency by n + 1.
Undefined
WO
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PDF描述
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