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參數(shù)資料
| 型號： | PTM1300AEBEA |
| 廠商： | NXP SEMICONDUCTORS |
| 元件分類： | 消費家電 |
| 英文描述： | Programmable Media Processor |
| 中文描述： | SPECIALTY CONSUMER CIRCUIT, PBGA292 |
| 封裝： | PLASTIC, SOT-553-1, BGA-292 |
| 文件頁數(shù)： | 311/533頁 |
| 文件大小： | 6857K |
| 代理商： | PTM1300AEBEA |
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Philips Semiconductors
DSPCPU Operations for TM1300
PRODUCT SPECIFICATION
A-25
Dual clipped add of signed 16-bit halfwords
SYNTAX
[ IF rguard ] dspidualadd rsrc1 rsrc2
→
rdest
FUNCTION
if
rguard
then {
temp1
←
sign_ext16to32(rsrc1<15:0>) + sign_ext16to32(rsrc2<15:0>)
temp2
←
sign_ext16to32(rsrc1<31:16>) + sign_ext16to32(rsrc2<31:16>)
if
temp1 < 0xffff8000
then
temp1
←
0x8000
if
temp2 < 0xffff8000
then
temp2
←
0x8000
if
temp1 > 0x7fff
then
temp1
←
0x7fff
if
temp2 > 0x7fff
then
temp2
←
0x7fff
rdest<31:16>
←
temp2<15:0>
rdest<15:0>
←
temp1<15:0>
}
ATTRIBUTES
Function unit
Operation code
Number of operands
Modifier
Modifier range
Latency
Issue slots
dspalu
70
2
No
—
2
1, 3
DESCRIPTION
As shown below, the
dspidualadd
operation computes two 16-bit clipped, signed sums separately on the two
pairs of high and low 16-bit halfwords of rsrc1 and rsrc2 Both sums are clipped into the range [2
15
–1..–2
15
] (or
[0x7fff..0x8000]) and written into the corresponding halfwords of rdest All values are signed 16-bit integers.
The
dspidualadd
operation optionally takes a guard, specified in rguard If a guard is present, its LSB controls the
modification of the destination register. If the LSB of rguardis 1, rdestis written; otherwise, rdestis not changed.
EXAMPLES
Initial Values
Operation
Result
r30 = 0x12340032, r40 = 0x00010002
r10 = 0, r30 = 0x12340032, r40 = 0x00010002
dspidualadd r30 r40
→
r60
IF r10 dspidualadd r30 r40
→
r70
r60
←
0x12350034
no change, since guard is
false
r100
←
0x12350034
r90
←
0x80007fff
r125
←
0x7fff7fff
r20 = 1, r30 = 0x12340032, r40 = 0x00010002
r50 = 0x80000001, r80 = 0xffff7fff
r110 = 0x00017fff, r120 = 0x7fff7fff
IF r20 dspidualadd r30 r40
→
r100
dspidualadd r50 r80
→
r90
dspidualadd r110 r120
→
r125
0
1
3
rsrc1
0
1
3
rsrc2
0
3
rdest
+
+
1
0
1
0
1
Two full-precision
17-bit signed sums
Clip to [2
15
–1 .. –2
15
]
Clip to [2
15
–1 .. –2
15
]
signed
signed
signed
signed
signed
signed
signed
signed
SEE ALSO
dspidualabs dspidualmul
dspidualsub dspiabs
dspidualadd
相關(guān)PDF資料 |
PDF描述 |
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參數(shù)描述 |
|---|---|
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