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參數(shù)資料
| 型號： | pentium II cpu |
| 廠商： | Intel Corp. |
| 英文描述： | Pentium II Processor AT 450MHZ(工作頻率450兆赫茲奔II處理器) |
| 中文描述： | 奔騰II處理器在450MHz（工作頻率450兆赫茲奔二處理器） |
| 文件頁數(shù)： | 37/84頁 |
| 文件大?。?/td> | 1092K |
| 代理商： | PENTIUM II CPU |
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Pentium
II Processor at 350 MHz, 400 MHz, and 450 MHz
Datasheet
37
3.1
System Bus Clock (BCLK) Signal Quality Specifications and
Measurement Guidelines
Table 21
describes the signal quality specifications at the processor core for the Pentium II
processor system bus clock (BCLK) signal.
Table 22
describes guidelines for signal quality
measurement at the processor edge fingers.
Figure 13
describes the signal quality waveform for the
system bus clock at the processor core pins.
Figure 14
describes the signal quality waveform for the
system bus clock at the processor edge fingers.
NOTES:
1. Unless otherwise noted, all specifications in this table apply to all Pentium
II processor frequencies and cache sizes.
2. This is the Pentium II processor system bus clock overshoot and undershoot specification for 100-MHz system bus
operation.
3. The rising and falling edge ringback voltage specified is the minimum (rising) or maximum (falling) absolute voltage
the BCLK signal can dip back to after passing the V
IH
(rising) or V
IL
(falling) voltage limits. This specification is an
absolute value.
Table 21. BCLK Signal Quality Specifications for Simulation at the Processor Core
1
T# Parameter
Min
Nom
Max
Unit
Figure
Notes
V1: BCLK V
IL
0.5
V
13
V2: BCLK V
IH
2.0
V
13
2
V3: V
IN
Absolute Voltage Range
–0.7
3.3
V
13
2
V4: Rising Edge Ringback
1.7
V
13
3
V5: Falling Edge Ringback
0.7
V
13
3
Figure 13. BCLK, TCK, PICCLK Generic Clock Waveform at the Processor Core Pins
V2
V1
V3
V3
T3
V5
V4
T6
T4
T5
V
Time
V2
V1
相關(guān)PDF資料 |
PDF描述 |
|---|---|
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