參數(shù)資料
型號(hào)： PCI1620PDV
英文描述： Controller Miscellaneous - Datasheet Reference
中文描述： 控制器雜項(xiàng)-數(shù)據(jù)表參考
文件頁(yè)數(shù)： 155/164頁(yè)
文件大?。?/td> 720K
代理商： PCI1620PDV
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8
–
3
8.3
otherwise noted)
Electrical Characteristics Over Recommended Operating Conditions (unless
PARAMETER
PINS
OPERATION
TEST CONDITIONS
MIN
MAX
UNIT
PCI
3.3 V
IOH =
–
0.5 mA
IOH =
–
2 mA
IOH =
–
0.15 mA
IOH =
–
0.15 mA
IOH =
–
4 mA
IOL =
–
8 mA
IOH =
–
4 mA
IOH =
–
8 mA
IOL = 1.5 mA
IOL = 6 mA
IOL = 0.7 mA
IOL = 0.7 mA
IOL = 4 mA
IOL = 8 mA
IOL = 4 mA
IOL = 8 mA
IOL = 8 mA
VI = VCC
VI = VCC
VI = VCC
VI = VCC
VI = GND
VI = GND
VI = GND
VI = VCC
VI = VCC
VI = VCC
VI = VCC
VI = VCC
0.9 VCC
5 V
2.4
PC Card
3.3 V
0.9 VCC
VOH
Hi h l
High-level output voltage
5 V
2.4
V
PHY I/F
3.3 V
2.8
3.3 V
VCC
–
0.6
VCC
–
0.6
VCC
–
0.6
TTL
PCI
3.3 V
0.1 VCC
0.55
5 V
PC Card
3.3 V
0.1 VCC
0.55
5 V
VOL
Low-level output voltage
Low level out ut voltage
PHY I/F
3.3 V
0.5
V
3.3 V
0.5
TTL
0.5
0.5
SERR
0.5
IOZL
3-state output, high-impedance state
3-state out ut, high-im edance state
current
Output pins
3.6 V
–
1
5.25 V
–
1
μ
A
IOZH
3-state output, high-impedance state
3-state out ut, high-im edance state
current
Output pins
3.6 V
10
5.25 V
25
μ
A
Input pins
–
1
IIL
Low-level input current
e e
I/O pins
Latch
–
10
A
μ
u cu e
–
2
Input pins
3.6 V
10
5.25 V
20
IIH
High-level input current
e e
I/O pins
3.6 V
10
A
μ
u cu e
5.25 V
3.6 V
25
10
Fail-safe pins
For PCI terminals, VI = VCCP. For PC Card terminals, VI = VCC(A/B). For ZV terminals, VI = VCC. For miscellaneous terminals, VI = VCC.
For I/O terminals, input leakage (IIL and IIH) includes the IOZ leakage of the disabled output.
8.4
Voltage and Operating Free-Air Temperature (see Figure 8
–
2 and Figure 8
–
3)
PCI Clock/Reset Timing Requirements Over Recommended Ranges of Supply
PARAMETER
ALTERNATE
SYMBOL
TEST
CONDITIONS
MIN
MAX
UNIT
tc
twH
twL
tr, tf
tw
tsu
Cycle time, PCLK
tcyc
thigh
tlow
v/
t
30
ns
Pulse duration, PCLK high
11
ns
Pulse duration, PCLK low
11
ns
Slew rate, PCLK
1
4
V/ns
Pulse duration, RSTIN
trst
1
ms
Setup time, PCLK active at end of RSTIN
trst-clk
100
s
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