參數(shù)資料
型號(hào)： MCF5249VM140
廠商： FREESCALE SEMICONDUCTOR INC
元件分類： 微控制器/微處理器
英文描述： 32-BIT, 140 MHz, RISC PROCESSOR, PBGA160
封裝： 15 X 15 MM, MAPBGA-160
文件頁(yè)數(shù)： 437/454頁(yè)
文件大?。?/td> 6701K
代理商： MCF5249VM140
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Instruction Cache Programming Model
MOTOROLA
Instruction Cache
5-5
5.4
INSTRUCTION CACHE PROGRAMMING MODEL
Three supervisor registers define the operation of the instruction cache and local bus controller: the Cache
Control Register (CACR) and two Access Control Registers (ACR0, ACR1).
5.4.1
INSTRUCTION CACHE REGISTERS MEMORY MAP
Table 5-3 shows the memory map of the Instruction cache and access control registers.
The following list describes several key issues regarding the programming model table:
The Cache Control Register and Access Control Registers can only be accessed in supervisor mode
using the MOVEC instruction with an Rc value of $002, $004 and $005, respectively.
Addresses not assigned to the registers and undefined register bits are reserved for future
expansion. Write accesses to these reserved address spaces and reserved register bits have no
effect; read accesses will return zeros.
The reset value column indicates the initial value of the register at reset. Certain registers may be
uninitialized upon reset, i.e., they may contain random values after reset.
The access column indicates if the corresponding register allows both read/write functionality (R/W),
read-only functionality (R), or write-only functionality (W). If a read access to a write-only register is
attempted, zeros will be returned. If a write access to a read-only register is attempted the access will be
ignored and no write will occur.
Table 5-2 Instruction Cache Operation as Defined by CACR[31,10]
CACR[31]
CACR[10]
TYPE OF
INSTR. FETCH
DESCRIPTION
0
N/A
Instruction cache is completely disabled; all fetches are
word, longword in size.
0
1
N/A
All fetches are word, longword in size
1
X
Cacheable
Fetch size is defined by Table 4-1 and contents of the
line-fill buffer can be written into the memory array
1
0
Noncacheable
All fetches are longword in size, and not loaded into the
line-fill buffer
1
Noncacheable
Fetch size is defined by Table 4-1 and loaded into the
line-fill buffer, but are never written into the memory
array.
F
re
e
sc
a
le
S
e
m
ic
o
n
d
u
c
to
r,
I
Freescale Semiconductor, Inc.
For More Information On This Product,
Go to: www.freescale.com
n
c
..
.
相關(guān)PDF資料
PDF描述
MCF5249VF140 32-BIT, 140 MHz, RISC PROCESSOR, PBGA160
MCF5251CDVM140 32-BIT, 140 MHz, MICROPROCESSOR, PBGA225
MCF5251CEVM140 32-BIT, 140 MHz, MICROPROCESSOR, PBGA225
MCF5251EVM140 32-BIT, 140 MHz, MICROPROCESSOR, PBGA225
MCF54417CMJ250 MICROPROCESSOR, PBGA256
相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
MCF5251 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:ColdFire㈢ Microprocessor
MCF5251_07 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:ColdFire㈢ Microprocessor Data Sheet
MCF5251_08 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:ColdFire㈢ Microprocessor
MCF5251CDVM140 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:ColdFire Processor
MCF5251CEVM140 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:ColdFire Processor
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