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參數(shù)資料
| 型號： | MCF5249VM140 |
| 廠商： | FREESCALE SEMICONDUCTOR INC |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 32-BIT, 140 MHz, RISC PROCESSOR, PBGA160 |
| 封裝： | 15 X 15 MM, MAPBGA-160 |
| 文件頁數(shù)： | 309/454頁 |
| 文件大?。?/td> | 6701K |
| 代理商： | MCF5249VM140 |
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Real-Time Debug Support
MOTOROLA
Debug Support
19-35
Table 19-31 Trigger Definition Register (TDR)
BITS
31
30
29
28
27
26
25
24
23
22
21
20
19
18
17
16
FIELD
TRC
EDLW
EDWL
EDWU
EDLL
EDLM
EDUM
EDUU
DI
EAI
EAR
EAL
EPC
PCI
RESET
0
R/W
WRITE ONLY
BITS
15
14
13
12
11
10
9
8
7
6
5
4
3
2
1
0
FIELD
LXT
EBL
EDLW
EDWL
EDWU
EDLL
EDLM
EDUM
EDUU
DI
EAI
EAR
EAL
EPC
PCI
RESET
0
R/W
WRITE ONLY
Table 19-32 Trigger Definition Bit Descriptions
BIT NAME
DESCRIPTION
TRC
The trigger response control determines how the processor is to respond to a completed
trigger condition. The trigger response is always displayed on the DDATA pins.
00 = display on DDATA only
01 = processor halt
10 = debug interrupt
11 = reserved
TDR[15]
0 = Level-2 trigger = PC_condition & Address_range & Data_condition
1 = Level-2 trigger = PC_condition | (Address_range & Data_condition)
TDR[14]
0 = Level-1 trigger = PC_condition & Address_range & Data_condition
1 = Level-1 trigger = PC_condition | (Address_range & Data_condition)
EBL
If set, the Enable Breakpoint Level bit serves as the global enable for the breakpoint trigger. If
cleared, all breakpoints are disabled.
EDLW
If set, the Enable Data Breakpoint for the Data Longword bit enables the data breakpoint
based on the entire processor’s local data bus. The assertion of any of the ED bits enables
the data breakpoint. If all bits are cleared, the data breakpoint is disabled.
EDWL
If set, the Enable Data Breakpoint for the Lower Data Word bit enables the data breakpoint
based on the low-order word of the processor’s local data bus.
EDWU
If set, the Enable Data Breakpoint for the Upper Data Word bit enables the data breakpoint
trigger based on the high-order word of the processor’s local data bus.
EDLL
If set, the Enable Data Breakpoint for the Lower Data Byte bit enables the data breakpoint
trigger based on the low-order byte of the low-order word of the processor’s local data bus.
EDLM
If set, the Enable Data Breakpoint for the Lower Lower Middle Data Byte bit enables the data
breakpoint trigger based on the high-order byte of the low-order word of the processor’s local
data bus.
EDUM
If set, the Enable Data Breakpoint for the Upper Middle Data Byte bit enables the data
breakpoint trigger on the low-order byte of the high-order word of the processor’s local data
bus.
EDUU
If set, the Enable Data Breakpoint for the Upper Upper Data Byte bit enables the data
breakpoint trigger on the high-order byte of the high-order word of the processor’s local data
bus.
DI
F
re
e
sc
a
le
S
e
m
ic
o
n
d
u
c
to
r,
I
Freescale Semiconductor, Inc.
For More Information On This Product,
Go to: www.freescale.com
n
c
..
.
相關PDF資料 |
PDF描述 |
|---|---|
| MCF5249VF140 | 32-BIT, 140 MHz, RISC PROCESSOR, PBGA160 |
| MCF5251CDVM140 | 32-BIT, 140 MHz, MICROPROCESSOR, PBGA225 |
| MCF5251CEVM140 | 32-BIT, 140 MHz, MICROPROCESSOR, PBGA225 |
| MCF5251EVM140 | 32-BIT, 140 MHz, MICROPROCESSOR, PBGA225 |
| MCF54417CMJ250 | MICROPROCESSOR, PBGA256 |
相關代理商/技術參數(shù) |
參數(shù)描述 |
|---|---|
| MCF5251 | 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:ColdFire㈢ Microprocessor |
| MCF5251_07 | 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:ColdFire㈢ Microprocessor Data Sheet |
| MCF5251_08 | 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:ColdFire㈢ Microprocessor |
| MCF5251CDVM140 | 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:ColdFire Processor |
| MCF5251CEVM140 | 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:ColdFire Processor |
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