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參數(shù)資料
| 型號： | MCF5249VM140 |
| 廠商： | FREESCALE SEMICONDUCTOR INC |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 32-BIT, 140 MHz, RISC PROCESSOR, PBGA160 |
| 封裝： | 15 X 15 MM, MAPBGA-160 |
| 文件頁數(shù)： | 43/454頁 |
| 文件大?。?/td> | 6701K |
| 代理商： | MCF5249VM140 |
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SIM Programming and Configuration
MOTOROLA
System Integration Module
9-3
9.3
SIM PROGRAMMING AND CONFIGURATION
9.3.1
MODULE BASE ADDRESS REGISTERS
The base address of all internal peripherals is determined by the MBAR and MBAR2 registers.
The MBAR and MBAR2 are 32-bit write-only supervisor control register that physically reside in the SIM.
They are accessed in the CPU address spaces $C0F and $C0E using the MOVEC instruction. Refer to the
ColdFire Family Programmer’s Reference Manual for use of MOVEC instruction. The MBAR and MBAR2
can be read when in debug mode using background debug commands.
At system reset, the MBAR valid bits (MBAR[0], MBAR2[0]) are cleared to prevent incorrect reference to
resources before the MBAR or MBAR2 are written. The remainder of the MBAR or MBAR2 bits are
uninitialized. To access the MBAR and MBAR2 peripherals, users should write MBAR and MBAR2 with
the appropriate base address and set the valid bit after system reset.
The MBAR2 base address defines a single relocatable memory block along 1024-Mbyte boundaries. If the
MBAR2 valid bit is set, the base address field is compared to the upper two bits of the full 32-bit internal
address to determine if an MBAR2 peripheral is being accessed.
Any processor bus access is first compared for SRAM match (RAMBAR registers), then it is compared
against MBAR and MBAR2. If no match is found in any of these registers, the cycle will be mapped to the
Chip Select and SDRAM units.
Table 9-3 shows the bits in the module base address register (MBAR), and Table 9-5 shows the bits in the
MBAR2.
ADDRESS
DESCRIPTION
0123
MBAR2 + $0B8 gpio 32-63 output enable reg
GPIO1-ENABLE
MBAR2 + $0BC gpio 32-63 function select
GPIO1-FUNCTION
MBAR2 + $140 secondary interrupts 0-7 priority
INTPRI1
MBAR2 + $144 secondary interrupts 8-15 priority
INTPRI2
MBAR2 + $148 secondary interrupts 16-23 priority
INTPRI3
MBAR2 + $14C secondary interrupts 24-31 priority
INTPRI4
MBAR2 + $150 secondary interrupts 32-39 priority
INTPRI5
MBAR2 + $154 secondary interrupts 40-47 priority
INTPRI6
MBAR2 + $158 secondary interrupts 48-55 priority
INTPRI7
MBAR2 + $15C secondary interrupts 56-63 priority
INTPRI8
MBAR2 + $164 Spurious secondary interrupt vector
SPURVEC
MBAR2 + $168 secondary interrupt base vector register
INTBASE
MBAR2 + $198 software interrupts and interrupt monitor
EXTRAINT
Table 9-2 SIM Memory Map (Continued)
F
re
e
sc
a
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S
e
m
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o
n
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u
c
to
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I
Freescale Semiconductor, Inc.
For More Information On This Product,
Go to: www.freescale.com
n
c
..
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相關(guān)PDF資料 |
PDF描述 |
|---|---|
| MCF5249VF140 | 32-BIT, 140 MHz, RISC PROCESSOR, PBGA160 |
| MCF5251CDVM140 | 32-BIT, 140 MHz, MICROPROCESSOR, PBGA225 |
| MCF5251CEVM140 | 32-BIT, 140 MHz, MICROPROCESSOR, PBGA225 |
| MCF5251EVM140 | 32-BIT, 140 MHz, MICROPROCESSOR, PBGA225 |
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
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| MCF5251 | 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:ColdFire㈢ Microprocessor |
| MCF5251_07 | 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:ColdFire㈢ Microprocessor Data Sheet |
| MCF5251_08 | 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:ColdFire㈢ Microprocessor |
| MCF5251CDVM140 | 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:ColdFire Processor |
| MCF5251CEVM140 | 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:ColdFire Processor |
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