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參數(shù)資料
| 型號： | MC92610VF |
| 廠商： | FREESCALE SEMICONDUCTOR INC |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | SPECIALTY MICROPROCESSOR CIRCUIT, PBGA324 |
| 封裝： | 19 X 19 MM, 1.76 MM HEIGHT, 1 MM PITCH, PLASTIC, MS-034AAG-1, MAPBGA-324 |
| 文件頁數(shù)： | 84/104頁 |
| 文件大小： | 1595K |
| 代理商： | MC92610VF |
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7-6
MC92610 SERDES User’s Manual
MOTOROLA
MC92610 Chip Pinout Listing
XMIT_A_CLK
Transmitter A, Transmit Interface Clock
U7
Input
HSTL
RECV_A_0
Receiver A, Data bit 0
P2
Output
HSTL
RECV_A_1
Receiver A, Data bit 1
P3
Output
HSTL
RECV_A_2
Receiver A, Data bit 2
R1
Output
HSTL
RECV_A_3
Receiver A, Data bit 3
R3
Output
HSTL
RECV_A_4
Receiver A, Data bit 4
M4
Output
HSTL
RECV_A_5
Receiver A, Data bit 5
N4
Output
HSTL
RECV_A_6
Receiver A, Data bit 6
T1
Output
HSTL
RECV_A_7
Receiver A, Data bit 7
T2
Output
HSTL
RECV_A_K
Receiver A, Special Character (Data bit 8 for
TBI mode)
T3
Output
HSTL
RECV_A_9
Receiver A, Data bit 9 for TBI mode
P4
Output
HSTL
RECV_A_IDLE
Receiver A, Idle Detect
U2
Output
HSTL
RECV_A_ERR
Receiver A, Error Detect
V2
Output
HSTL
RECV_A_CLK
Receiver A, Receive Data Clock
P5
Output
HSTL
XCVR_A_RSEL
Transceiver A, Redundant Link Select
P11
Input
CMOS
XCVR_A_DISABLE
Transceiver A, Disable
D13
Input
CMOS
RLINK_A0_P
Receiver A, Primary Positive Link Input
U18
Input
Link
RLINK_A0_N
Receiver A, Primary Negative Link Input
V18
Input
Link
RLINK_A1_P
Receiver A, Redundant Positive Link Input
U16
Input
Link
RLINK_A1_N
Receiver A, Redundant Negative Link Input
V16
Input
Link
XLINK_A0_P
Transmitter A, Primary Positive Link Out
R17
Output
Link
XLINK_A0_N
Transmitter A, Primary Negative Link Out
T17
Output
Link
XLINK_A1_P
Transmitter A, Redundant Positive Link Out
R15
Output
Link
XLINK_A1_N
Transmitter A, Redundant Negative Link Out
T15
Output
Link
XMIT_B_0
Transmitter B, Data bit 0
R6
Input
HSTL
XMIT_B_1
Transmitter B, Data bit 1
V5
Input
HSTL
XMIT_B_2
Transmitter B, Data bit 2
U5
Input
HSTL
XMIT_B_3
Transmitter B, Data bit 3
T5
Input
HSTL
XMIT_B_4
Transmitter B, Data bit 4
U4
Input
HSTL
XMIT_B_5
Transmitter B, Data bit 5
R5
Input
HSTL
XMIT_B_6
Transmitter B, Data bit 6
T4
Input
HSTL
XMIT_B_7
Transmitter B, Data bit 7
R4
Input
HSTL
Table 7-2. 324 MAPBGA Signal to Ball Mapping (continued)
Signal Name
Description
Ball Number
(324 MAPBGA)
Direction
I/O Type
F
re
e
sc
a
le
S
e
m
ic
o
n
d
u
c
to
r,
I
Freescale Semiconductor, Inc.
For More Information On This Product,
Go to: www.freescale.com
n
c
..
.
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PDF描述 |
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