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參數(shù)資料
| 型號(hào)： | MC68349FT25 |
| 廠商： | MOTOROLA INC |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 32-BIT, MICROCONTROLLER, PQFP16 |
| 封裝： | PLASTIC, QFP-160 |
| 文件頁數(shù)： | 75/420頁 |
| 文件大?。?/td> | 1645K |
| 代理商： | MC68349FT25 |
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MOTOROLA
MC68349 USER’S MANUAL
5- 11
ADDR
FC
31
0
FC0
S
Module Configuration Register (MCR)
FC4
S
SRAM Base Address Register 0 (BADDR0)
FC8
S
SRAM Base Address Register 1 (BADDR1)
FCC
S
SRAM Base Address Register 2 (BADDR2)
FD0
S
SRAM Base Address Register 3 (BADDR3)
Figure 5-7. CIC Programming Model
5.2.2.1 MODULE CONFIGURATION REGISTER (MCR). The MCR controls the CIC
configuration. The register can be either read or written in supervisor state.
MCR
$FC0
31
16
Reserved
RESET:
0000000000000000
15
13
12
11
10
9876543210
Reserved
LWP3
LWP2
LWP1
LWP0
INV3
INV2
INV1
INV0
MD3
MD2
MD1
MD0
ENAB
RESET
0000000000000000
Supervisor Only
Bits 31–13—Reserved by Motorola
LWP3–0—Lock/write-protect corresponding CIC block
In blocks configured as instruction cache, the LWP bits indicate the lock status of the
cache set.
1 = The set is locked. No lines will be replaced.
0 = The set is not locked. Lines may be replaced during misses or loads.
In blocks configured as SRAM, the LWP bits indicate the write-protect status of the
SRAM banks.
1 = The SRAM bank is write-protected. An attempt to write to the bank returns BERR .
0 = The SRAM bank is read/write.
INV3–0—Invalidate bits for corresponding instruction cache sets
The INV bits provide a way to invalidate the entire contents of sets in the instruction
cache. These bits are write-only and any read attempts will return 0 (i.e., one-shot
function for invalidating sets). Each set used for cache should be explicitly invalidated
when first enabling the CIC.
1 = All lines in the set will be invalidated.
0 = Set line validity is not affected.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| MC68356CZP25 | 3 CHANNEL(S), 115K bps, SERIAL COMM CONTROLLER, PBGA357 |
| MC68356ZP25 | 3 CHANNEL(S), 115K bps, SERIAL COMM CONTROLLER, PBGA357 |
| MC6840L | 3 TIMER(S), PROGRAMMABLE TIMER, CDIP28 |
| MC68A40L | 3 TIMER(S), PROGRAMMABLE TIMER, CDIP28 |
| MC68A40CL | 3 TIMER(S), PROGRAMMABLE TIMER, CDIP28 |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| MC68349FT25A | 制造商:Motorola Inc 功能描述: |
| MC68349V | 制造商:MOTOROLA 制造商全稱:Motorola, Inc 功能描述:HIGH PERFORMANCE INTEGRATED PROCESSOR |
| MC6835 | 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:8-BIT MPUS, 8-BIT MCUS, 8-BIT PERIPHERALS |
| MC68360 | 制造商:MOTOROLA 制造商全稱:Motorola, Inc 功能描述:QUad Integrated Communications Controller Users Manual |
| MC68360AD | 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:MC68360 QUad Integrated Communication Controller (QUICCa?￠) |
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