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參數(shù)資料
| 型號： | MC68349FT25 |
| 廠商： | MOTOROLA INC |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 32-BIT, MICROCONTROLLER, PQFP16 |
| 封裝： | PLASTIC, QFP-160 |
| 文件頁數(shù)： | 70/420頁 |
| 文件大?。?/td> | 1645K |
| 代理商： | MC68349FT25 |
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5- 6
MC68349 USER’S MANUAL
MOTOROLA
5.1.6 Addressing Modes
Addressing in the CPU32+ is register oriented. Most instructions allow the results of the
specified operation to be placed either in a register or directly in memory; this flexibility
eliminates the need for extra instructions to store register contents in memory.
The seven basic addressing modes are as follows:
Register Direct
Register Indirect
Register Indirect with Index
Program Counter Indirect with Displacement
Program Counter Indirect with Index
Absolute
Immediate
Included in the register indirect addressing modes are the capabilities to postincrement,
predecrement, and offset. The PC relative mode also has index and offset capabilities. In
addition to these addressing modes, many instructions implicitly specify the use of the SR,
SP and/or PC. Addressing is explained fully in the M68000PM/AD,
M68000 Family
Programmer’s Reference Manual.
5.2 CONFIGURABLE INSTRUCTION CACHE OVERVIEW
The CIC contains four dual-purpose memory blocks which can be independently
configured as either instruction cache or SRAM. When configured as cache, each block
provides 256 bytes of instruction cache, for a maximum 1-kbyte cache. The instruction
cache improves system performance by providing cached instructions to the CPU32+ with
very low latency. Alternatively, each element can be used as 512 bytes of SRAM, for a
maximum of 2-kbytes SRAM. When configured as SRAM, the CIC provides a fast memory
for general storage of data and/or instructions. The functionality of the blocks is
independently programmable to allow a mix of instruction cache and SRAM for different
applications. A high-level system diagram is shown in Figure 5-3.
A key feature of the CIC is its direct data path to the CPU32+. CPU accesses to the CIC
do not require use of the IMB, resulting in increased IMB bandwidth available to other bus
masters such as the DMA controller. This direct connection helps minimize the impact of
DMA activity on CPU performance. The direct data path prevents accesses to the CIC by
other modules on the IMB; hence, the CIC cannot be accessed from the IMB by the DMA
controller.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| MC68356CZP25 | 3 CHANNEL(S), 115K bps, SERIAL COMM CONTROLLER, PBGA357 |
| MC68356ZP25 | 3 CHANNEL(S), 115K bps, SERIAL COMM CONTROLLER, PBGA357 |
| MC6840L | 3 TIMER(S), PROGRAMMABLE TIMER, CDIP28 |
| MC68A40L | 3 TIMER(S), PROGRAMMABLE TIMER, CDIP28 |
| MC68A40CL | 3 TIMER(S), PROGRAMMABLE TIMER, CDIP28 |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| MC68349FT25A | 制造商:Motorola Inc 功能描述: |
| MC68349V | 制造商:MOTOROLA 制造商全稱:Motorola, Inc 功能描述:HIGH PERFORMANCE INTEGRATED PROCESSOR |
| MC6835 | 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:8-BIT MPUS, 8-BIT MCUS, 8-BIT PERIPHERALS |
| MC68360 | 制造商:MOTOROLA 制造商全稱:Motorola, Inc 功能描述:QUad Integrated Communications Controller Users Manual |
| MC68360AD | 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:MC68360 QUad Integrated Communication Controller (QUICCa?￠) |
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